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基于cycloneⅡ的高速异步串行接口的实现
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上传时间: 2009-05-25
详细说明： 基于 cyc I one II 的高速异步串行接口的实现 宋开 鑫，李 斌 ，王 婧 ，靖 文，张嘉春 ，孙新立 (沈阳理工大学，辽宁 沈阳 100168 ) 【摘 要 】文章首先介绍 了系统的总体结构 ，然后详细论述 了系统各个组成部分 的原理和 3-作 过程 ，主要 论证 了如何利用 锁相环进行 5 倍采样从而实现位同步和串并转换，然后用 FIFO 来实现时钟域的转换 ，外加一些必要的设置，最终实现了利用 现 场可编程逻辑 器件 cyclone 1I 对 150M 数据正确 的接收和转发 。 【关键词】 并串＼串并转换；位同步；锁相环；Verilog HDL 【中图分类号】TP303 【文献标识码】A 【文章编号】1008- 1151(2008)01―0065―02 (一 ) 研究背景 一 直以来，高速数据的接收始终是一个难题，由于必须 采用本地高频时钟来进行位同步，所以用 FPGA来 ...展开收缩
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