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上传时间: 2021-02-23
详细说明：本文介绍了一种高速宽带二分频分频器的设计和分析。 拟议的分频器是一种动态源耦合逻辑（DSCL）结构，该结构由两个动态加载的主从D锁存器组成，可实现高频工作和低功耗。 该分频器的锁定范围为7-27 GHz，1.2 V电源的最小功耗仅为1.22 mW。 在整个工作频率范围内，输入灵敏度低至-25.4 dBm。 该芯片采用两个90nm CMOSCraft.io的片上螺旋电感器，占地685×430μm2。
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