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上传时间: 2010-05-15
详细说明： eda实验指导程序实验一 1位全加器设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••23 实验二 两位十进制计数器设计••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••32 实验三 8位串入并出寄存器设计••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••34 实验四 2选1多路选择器VHDL设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••36 实验五 1位全加器VHDL设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••40 实验六 8位硬件加法器VHDL设计••••••••••••••••••••••• ••••••••••••••••••••••••••••••••••••••••••••••••••••42 实验七 含异步清0和同步时钟使能的4位加法计数器设计•••••••••••••••••••••••••••••••••••••••44 实验八 7段数码显示计数器设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••46 实验九 4位十进制频率计设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••48 实验十 用状态机实现序列检测器的设计••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••50 实验十一 数字钟的设计••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••52 实验十二 用状态机对ADC0809的采样控制电路实现••••••••••••••••••••••••••••••••••••••••••••••••••••••54 ...展开收缩
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