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单片机多机冗余设计及控制模块的VHDL语言描述
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文件大小: 115kb
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上传时间: 2021-02-03
详细说明：摘要：以三个单片机组成的系统为例介绍一种单片机多机冗余容错设计。阐述设计中关键的时钟同步技术和总线仲裁方法，给出控制模块的VHDL语言描述。 本文提出一种表决式单片机多机冗余设计方案。该方案不同于中央系统的多机冗余设计。大规模系统冗余大多采用完善而复杂的机间通讯协议实现系统重构，不太注重系统的实时性。本方案结构简单，易于实现，具有极强的实时性，没有电子开关切换总线的咔嗒声输出。单片机价格低廉、功能灵活，也使得该设计在类似仪器仪表的小系统中的运用成为可能。1设计原理设计结构如图1所示。完成整个冗余设计的电路被置于一个核心控制模块中，如果该模块以FPGA实现也就是一块芯片。图1中单片机1、2、3被
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