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一种高效硬件的多分辨率块匹配算法及其VLSI架构，适用于像MPEG的高清MPEG视频编码器
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文件大小: 2mb
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上传时间: 2021-04-01
详细说明：高吞吐量，高带宽需求，巨大的片上存储器消耗以及复杂的数据流控制是高清整数运动估计硬件实现中的主要挑战。 提出了一种基于优化算法的整数多分辨率运动估计的高效超大规模集成架构。 本文主要有三点贡献。 首先，本文提出了一种非常适合高清视频编码器的硬件友好的多分辨率运动估计算法。 其次，提出了并行处理单元（PE）阵列结构来实现三级分层运动估计，通过有效的PE重用，一个参考帧实时高清运动估计只有256个PE足够。 第三，提出了整数和分数运动估计之间有效的片上参考像素缓冲区共享机制，同时节省了近50％的SRAM，并减少了内存带宽。 提出的多分辨率运动估计算法在速率失真优化的可变块大小运动估计支持下，在复杂度和性能之间达到了良好的平衡。 此外，我们还实现了适度的逻辑电路和片上SRAM消耗。 所提出的体系结构非常适合所有类似MPEG的视频编码标准，例如H.264，音频视频编码标准和VC-1。
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