开发工具:
文件大小: 5mb
下载次数: 0
上传时间: 2010-09-20
详细说明： 本文采用了一种全数字的电路结构设计了内置于FPGA芯片中的延迟锁相坏 结构。主要创新点包括:将传统DLL中的用模拟方式实现的环路滤波器和压控延 迟线改进为数字方式，避免了模拟电路缺乏稳态，对噪声敏感，抗干扰性能较差， 设计和制造过程中的复杂性高、可重用性差的问题，并针对现有的全数字电路结 构面积过大的，频率合成功能不够的问题对开环与闭环两种基本的DLL分别提出 了改进的方案。针对开环DLL占用面积过大的缺陷，设计了三层次的结构;而针 对闭环DLL频率覆盖范围不够广，面积较大的缺陷，设计了带隙基准控制的可控 延迟链
(系统自动生成,下载前可以参看下载内容)
下载文件列表
相关说明
- 本站资源为会员上传分享交流与学习,如有侵犯您的权益,请联系我们删除.
- 本站是交换下载平台，提供交流渠道，下载内容来自于网络，除下载问题外，其它问题请自行百度。
- 本站已设置防盗链，请勿用迅雷、QQ旋风等多线程下载软件下载资源，下载后用WinRAR最新版进行解压.
- 如果您发现内容无法下载，请稍后再次尝试；或者到消费记录里找到下载记录反馈给我们.
- 下载后发现下载的内容跟说明不相乎，请到消费记录里找到下载记录反馈给我们，经确认后退回积分.
- 如下载前有疑问，可以通过点击"提供者"的名字，查看对方的联系方式，联系对方咨询.
