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文件名称: FPGA--频率计数器
  所属分类: 硬件开发
  开发工具:
  文件大小: 2kb
  下载次数: 0
  上传时间: 2010-10-10
  提 供 者: xingrui*******
 详细说明: library ieee; use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity scan_led is port( clk:in std_logic; sg:out std_logic_vector(6 downto 0); bt:out std_logic_vector(7 downto 0)); end; architecture one of scan_led is signal cnt8:std_logic_vector(2 downto 0); signal a:integer range 0 to 15; begin p1:process(cnt8) begin case cnt8 is when "000"=>bt<="00000001";a<=1; when "001"=>bt<="00000010";a<=3; when "010"=& gt;bt<="00000100";a<=5; when "011"=>bt<="00001000";a<=7; when "100"=>bt<="00010000";a<=9; when "101"=>bt<="00100000";a<=11; when "110"=>bt<="01000000";a<=13; when "111"=>bt<="10000000";a<=15; when others=>null; ...展开收缩
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