您好,欢迎光临本网站![请登录][注册会员]  
文件名称: Verilog HDL异步设计与同步设计的时序分析
  所属分类: 硬件开发
  开发工具:
  文件大小: 6mb
  下载次数: 0
  上传时间: 2012-05-16
  提 供 者: sagat*****
 详细说明: (1) 理解亚稳态产生的物理意义 (2) 理解触发器本身的建立时间和保持时间以及异步复位恢复的概念 (3) 理解亚稳态恢复和同步寄存器的概念 (4) 理解组合逻辑的延迟产生的原理,掌握系统时钟频率的计算 (5) 理解并掌握时钟偏斜和抖动及其对时钟频率的影响 (6) 理解提高系统时钟频率的两种方法 (7) 了解False Path和多时钟周期的概念,知道使用False Path和多时钟周期进行时序约束。 (8) 理解并掌握芯片之间的时序接口设计 (9) 理解并掌握异步电路的设计方法
(系统自动生成,下载前可以参看下载内容)

下载文件列表

相关说明

  • 本站资源为会员上传分享交流与学习,如有侵犯您的权益,请联系我们删除.
  • 本站是交换下载平台,提供交流渠道,下载内容来自于网络,除下载问题外,其它问题请自行百度
  • 本站已设置防盗链,请勿用迅雷、QQ旋风等多线程下载软件下载资源,下载后用WinRAR最新版进行解压.
  • 如果您发现内容无法下载,请稍后再次尝试;或者到消费记录里找到下载记录反馈给我们.
  • 下载后发现下载的内容跟说明不相乎,请到消费记录里找到下载记录反馈给我们,经确认后退回积分.
  • 如下载前有疑问,可以通过点击"提供者"的名字,查看对方的联系方式,联系对方咨询.
 输入关键字,在本站1000多万海量源码库中尽情搜索: