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文件名称: VHDL 8位乘法器设计
  所属分类: C/C++
  开发工具:
  文件大小: 106kb
  下载次数: 0
  上传时间: 2012-06-24
  提 供 者: yy304******
 详细说明: 完整的实验报告 由8位加法器构成的以时序逻辑方式设计的8位乘法器。其乘法原理是:乘法通过逐项位移相加原理来实现,以被乘数的最低位开始,若为1,则乘数左移后与上一次和相加,若为0,左移后以全零相加,直至被乘数的最高位。
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