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文件名称: 常用组合逻辑电路设计
  所属分类: 专业指导
  开发工具:
  文件大小: 532kb
  下载次数: 0
  上传时间: 2013-06-21
  提 供 者: rebe****
 详细说明: 代码中实例化出各个下层子模块。 VHDL主要用于描述数字系统的结构,行为,功能和接口。除了含有许多具有硬件特征的语句外,VHDL的语言形式和描述风格与句法是十分类似于一般的计算机高级语言。VHDL的程序结构特点是将一项工程设计,或称设计实体(可以是一个元件,一个电路模块或一个系统)分成外部(或称可视部分,及端口)和内部(或称不可视部分),既涉及实体的内部功能和算法完成部分。在对一个设计实体定义了外部界面后,一旦其内部开发完成后,其他的设计就可以直接调用这个实体。这种将设计实体分成内外部分的概念是VHDL系统设计的基本点。
(系统自动生成,下载前可以参看下载内容)

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