文件名称:
MSP430F147单片机软核verilog实现
开发工具:
文件大小: 23mb
下载次数: 0
上传时间: 2013-12-31
详细说明： 1.实现了27条核心指令中的26条，没有实现BCD加法指令。 2.指令周期为6~8个机器周期，返回指令ret除外，需要11个机器周期 3.没有实现中断功能，所以类似定时器这类的外设没有添加，目前添加了乘法器外设，P1和P2端口，且P1和P2端口没有中断功能 4.流水线各个模块是异步工作方式，即前一级模块工作完成，下一级才开始工作。 5.留有外设接口，方便用户添加自定义外设 博客地址：blog.csdn.net/liguangmin123
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