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上传时间: 2014-07-03
详细说明： 提高SOC设计系统级设计阶段对集成IP核时序裕度的预见性和对需求IP 核选择评估准确性； 2)增强IP核时序适应能力，减少SOC集成时的粘合逻辑； 3)简化SOC中IP核的时钟约束。从而提高SOC整体性能： 4)提高了IP核对多时钟域和异步信号的处理能力，避免在SOC集成时引入 桥接模块。 5)增加IP核接口柔性，简化时序调整过程，缩短时序收敛时间。
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