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文件大小: 239kb
下载次数: 0
上传时间: 2009-12-13
详细说明： 1位全加器VHDL文本输入设计 2选1多路选择器VHDL设计 含异步清0和同步时钟使能的4位加法计数器 7段数码显示译码器设计 数控分频器的设计 用状态机实现序列检测器的设计 用状态机对A原理图输入设计含LPM的电路 DC0809的采样控制电路实现 硬件电子琴电路设计 循环冗余
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