文件名称:
dg_sata_ip_data_sheet_7series_en.pdf
开发工具:
文件大小: 320kb
下载次数: 0
上传时间: 2019-06-14
详细说明： SATA IP Transport & Link Layer Core Compliant with the Serial ATA specification revision 3.0 • Support both of SATA Host and SATA Device • Simple user interface and 32-bit data bus • Include two 4KB FIFOs to be data buffer • Support SATA III/II Speed and NCQ command • Require low user clock frequency (at least 150 MHz for SATA-I II or 75 MHz for SATA-II) • CONT primitive support for continue primitive suppression to reduce EMI • Provide SATA PHY including Xilinx transceiver as HDL code in reference design • Many IP options for SATA application, i.e. HCTL IP, AHCI IP, and FAT32 IP • Many reference designs on FPGA evaluation board (Most boards require AB09-FMCRAID adapter)
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