文件名称:
用verilog编写16位加法器乘法器自动售货机.pdf
开发工具:
文件大小: 282kb
下载次数: 0
上传时间: 2020-04-27
详细说明：包括如下实验的verilog设计报告：实验 1 十六位超前进位加法器、实验二 十六位加减法器、实验三 十六位的乘法器、实验四 自动售货机设计。有设计思路、程序代码、测试代码和仿真波形结果。
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