文件名称:
基于Nexys4 DDR的FPGA串口模块，带缓冲FIFO
开发工具:
文件大小: 21mb
下载次数: 0
上传时间: 2019-07-07
详细说明：FPGA串口模块，原创作者为CrazyBingo，在《FPGA案例技巧与开发实例详解》中的串口模块基础上改造，加入串口缓冲区FIFO，无须关心使能信号。已在Nexys4 DDR开发板上验证，开发环境为Vivado 2015.4
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