文件名称:
简易计算机系统(CPU)综合设计设计报告及工程文件(VHDL).zip
开发工具:
文件大小: 5mb
下载次数: 0
上传时间: 2020-07-21
详细说明:按照给定的数据通路、数据格式和指令系统,使用 EDA 工具设计一台用硬连线逻辑控制的简易计算机。利用QuartusII平台,通过VHDL语言设计完成了一个简易CPU
(系统自动生成,下载前可以参看下载内容)
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