文件名称:
Verilog打造除法器驱动数码管（上）
开发工具:
文件大小: 81kb
下载次数: 0
上传时间: 2020-08-04
详细说明：记得很久以前，用单片机玩数码管的时候，我们用“%”和“/”将一个长长的数字一一分离出来逐个显示在数码管上。如今已不玩单片机很多年，想用Verilog打造一个数码管接口，用来实时显示一个“较长的”数字。比如前段时间，和一个学长“比赛”看谁用到较少的逻辑先驱动DS18B20，就需要将温度这个数字显示在数码管上。
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