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文件名称: 一种低噪声亚采样锁相环的设计
  所属分类: 其它
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  文件大小: 641kb
  下载次数: 0
  上传时间: 2020-10-16
  提 供 者: weixin_********
 详细说明:介绍了一种2.4 GHz的低噪声亚采样锁相环。环路锁定是利用亚采样鉴相器对压控振荡器的输出进行采样。不同于传统电荷泵锁相环,由于在锁定状态下没有分频器的作用,由鉴相器和电荷泵所产生的带内噪声不会被放大N2 倍,从而会使锁相环的带内噪声极大程度地减小。在输出电压摆幅相同的情况下,压控振荡器采用NMOSPMOS互补结构降低了锁相环的功耗。锁相环的设计在TSMC 180 nm CMOS工艺下完成,在1.8 V的供电电压下,锁相环功耗为7.2 mW。在偏移载波频率200 kHz处,环路的带内噪声为-124 dBc/Hz。
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