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上传时间: 2020-10-16
详细说明：针对基于串行结构控制器（如MCU、DSP）设计的交错有源功率因素校正(APFC)变换器存在运行速度慢、动态特性差的问题，提出了一种基于SOPC技术控制的交错APFC变换器架构。该架构采用并行结构FPGA作为开发平台，以NiosⅡ软核处理器为核心，运行速度快，提升了系统的整体性能。文中设计了系统各模块的IP核，并构建了交错APFC变换器的SOPC系统。800 W的样机实验结果表明：该方案具有功率因素校正效果好、峰值限流能力强、动态响应速度快等优点。
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