文件名称:
采用CPLD/FPGA的VHDL语言电路优化原理设计
开发工具:
文件大小: 202kb
下载次数: 0
上传时间: 2020-10-23
详细说明:优化设计是可编成逻辑设计的精华所在,如何节省所占用的面积、如何提高设计的性能是可编成逻辑设计的核心,这两点往往也成为一个设计甚至项目成败的关键因素。下面结合超声探伤数据采集卡设计过程中,并基于Altera公司的EPM7192 CPLD芯片的编程经历来论述VHDL电路的优化方法。
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