文件名称:
基于DSP Builder的16阶FIR滤波器实现
开发工具:
文件大小: 539kb
下载次数: 0
上传时间: 2020-10-19
详细说明：在采用VHDL或VerilogHDL等硬件描述语言设计数字滤波器时。由于程序的编写往往不能达到良好优化而使滤波器性能表现一般，而采用调试好的IP Core需要向Al-tera公司购买。在此，采用一种基于DSP Builder的FPGA设计方法，使FIR滤波器设计较为简单易行，并能满足设计要求。
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