开发工具:
文件大小: 355kb
下载次数: 0
上传时间: 2020-10-17
详细说明：针对软件排序速度慢、排序数据量小以及占用CPU资源多等问题，设计了一种基于FPGA的硬件排序系统。排序过程采用DMA工作方式，不占用CPU资源；数据传输采用SISO（串行输入/串行输出）方式，减少FPGA内部布线资源，增强排序系统可靠性。利用Modelsim仿真工具对硬件排序系统进行仿真验证，仿真结果表明，硬件排序系统可以有效提高排序效率以及降低CPU使用率。
(系统自动生成,下载前可以参看下载内容)
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