文件名称:
用中档FPGA实现高速DDR3存储器控制器
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文件大小: 212kb
下载次数: 0
上传时间: 2020-10-26
详细说明：。在FPGA中实现高速、高效率的DDR3控制器是一项艰巨的任务。直到最近，只有少数高端（昂贵）的FPGA有支持与高速的DDR3存储器可靠接口的块。然而，现在新一代中档的FPGA提供这些块、高速FPGA架构、时钟管理资源和需要实现下一代DDR3控制器的I/O结构。本文探讨设计所遇到的挑战，以及如何用一个特定的FPGA系列LatticeECP3实现DDR3存储器控制器。
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