文件名称:
EDA/PLD中的基于逻辑组的快速宏布局方法
开发工具:
文件大小: 45kb
下载次数: 0
上传时间: 2020-11-05
详细说明：摘要：
本文介绍了一种适用于高宏数、难时序设计的快速平面布局方法。微捷码Talus可基于逻辑组产生所有宏和标准单元的快速布局。我们可通过利用这种布局信息来突出并划分适合的“宏组”，对于高宏数设计来说，这种方法要较一般的分组方法更快速更合理。对于时序关键设计，我们可使用积极的“宏布局”方法来显示关键逻辑组，然后再通过增量(incremental)的“宏布局”来调整布局形状(无宏或其它逻辑组阻塞的前提下将关键逻辑*在一起)；这种方法可为我们常规设计带好更好时序(包括WNS/TNS)和更好布线结果(总线长)。
1.介绍
一般来说，逻辑块级设计平面布局的主要工作就是宏布局。传统上，我
(系统自动生成,下载前可以参看下载内容)
下载文件列表
相关说明
- 本站资源为会员上传分享交流与学习,如有侵犯您的权益,请联系我们删除.
- 本站是交换下载平台，提供交流渠道，下载内容来自于网络，除下载问题外，其它问题请自行百度。
- 本站已设置防盗链，请勿用迅雷、QQ旋风等多线程下载软件下载资源，下载后用WinRAR最新版进行解压.
- 如果您发现内容无法下载，请稍后再次尝试；或者到消费记录里找到下载记录反馈给我们.
- 下载后发现下载的内容跟说明不相乎，请到消费记录里找到下载记录反馈给我们，经确认后退回积分.
- 如下载前有疑问，可以通过点击"提供者"的名字，查看对方的联系方式，联系对方咨询.
