文件名称:
EDA/PLD中的基于FPGA的数字复接系统帧同步器设计与实现
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文件大小: 74kb
下载次数: 0
上传时间: 2020-12-10
详细说明：摘要：介绍了应用ＦＰＧＡ技术进行帧同步器设计的实现原理、系统框图及设计中需要注意的问题，给出了用ＶＨＤＬ描述的几个模块的源代码。 关键词：数字复接；帧同步器；ＦＰＧＡ在数字通信网中，为了提高传输效率，常常需要将若干路低速数字信号合并成一路高速数字信号，以便通过高速信道进行传输。实现此功能的设备称为数字复接系统。数字复接系统包括发送端和接收端两部分，通常称为复接器和分接器。为了使分接器的帧状态相对于复接器的帧状态获得并保持相位关系，以便正确地实施分接，数字复接系统在发送端把低速数字信号合并为高速信号的同时，往往还要插入用于同步的帧同步码；而在接收端，分接器要把发送端数字信号中的帧同步码检测
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