文件名称:
SystemVerilog语言简介(三)
开发工具:
文件大小: 77kb
下载次数: 0
上传时间: 2020-12-09
详细说明：15. 强制类型转换 Verilog不能将一个值强制转换成不同的数据类型。SystemVerilog通过使用'操作符提供了数据类型的强制转换功能。这种强制转换可以转换成任意类型，包括用户定义的类型。例如： int' (2.0 * 3.0) // 将结果转换为int类型 mytype' (foo) // 将foo转换为mytype类型 一个值还可以通过在强制转换操作符前指定一个10进制数来转换成不同的向量宽度，例如： 17' (x - 2) // 将结果转换为17位宽度 也可以将结果转换成有符号值，例如： signed' (x) // 将x转换为有符号值
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