文件名称:
EDA/PLD中的Verilog HDL 数据流建模 --连续赋值语句
开发工具:
文件大小: 34kb
下载次数: 0
上传时间: 2020-12-09
详细说明：6 数据流建模 在3.3.2 节中，我们已经初步了解到数据流描述方式，本节对数据流的建模方式进一步讨论，主要讲述连续赋值语句、阻塞赋值语句、非阻塞赋值语句，并针对一个系统设计频率计数器的实例进行讲解。 6.1 连续赋值语句数据流的描述是采用连续赋值语句(assign )语句来实现的。语法如下：assign net_type = 表达式；连续赋值语句用于组合逻辑的建模。等式左边是wire 类型的变量。等式右边可以是常量、由运算符如逻辑运算符、算术运算符参与的表达。如下几个实例：wire [3:0] Z, Preset, Clear; //线网说明assign Z = Preset & Clear
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