文件名称:
EDA/PLD中的卷积码+QPSK的中频调制解调系统的FPGA实现
开发工具:
文件大小: 85kb
下载次数: 0
上传时间: 2020-12-13
详细说明：摘要：提出了一个采用（２，１，７）卷积码+QPSK的中频调制解调方案，并在Xilinx公司的100万门FPGA芯片上实现了该系统。该系统在信噪比SNR为6dB左右时可实现速率超过1Mbit/s、误码率小于10 -5的数据传输。 关键词：卷积编码 Viterbi译码 QPSK FPGA在无线数据传输中，由于信道中的噪声干扰，在接收端会引入一定的误码率（Bit Error Rate,BER）。高质量的数据业务要求较低的BER。为了达到较低的BER，经常采用信道编码技术。卷积编码和Viterbi译码是广泛使用的信道编码技术，具有一定的克服突发错误的能力，可以降低信道的误码率，带来很高的编码增益
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