文件名称:
EDA/PLD中的采用FPGA IP实现DDR的读写控制的设计与验证
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文件大小: 260kb
下载次数: 0
上传时间: 2020-12-13
详细说明：摘要： 本文采用LatticeXP系列FPGA结合IP解决DDR RAM的读写控制。并且在硬件上面进行了实际测试。关键词： 嵌入式系统；DDR RAM；FPGA；IP；LattcieXP
前言 随着高速处理器的不断发展，嵌入式系统应用的领域越来越广泛，数字信号处理的规模也越来越大，系统中RAM规模不断增加，比如视频监控、图像数据采集等领域，图像处理的实时性对RAM带宽的要求不断增加，传统的SDRAM在带宽上已经逐渐无法满足应用要求，DDR SDRAM(双倍速率SDRAM)采用在时钟CLK信号的上升和下降沿，双沿做数据传输；比传统的SDRAM只在时钟上升沿传输的方式，传输带宽增加了一倍。
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