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搜索资源列表

  1. 用Verilog代码编写的奇偶分频器

  2. 实现任意奇偶分频用Verilog编写的分频器//偶数倍分频：偶数倍分频应该是大家都比较熟悉的分频，通过计数器计数是完全可以实现的。如进行N倍偶数分频，那么可以通过由待分频的 //时钟触发计数器计数，当计数器从0计数到N/2-1时，输出时钟进行翻转，并给计数器一个复位信号，使得下一个时钟从零开始计数。以此循 //环下去。这种方法可以实现任意的偶数分频。

  3. 所属分类：C/C++

    • 发布日期：2010-05-28
    • 文件大小：27648
    • 提供者：olzzz

  1. fpga奇偶分频源代码实现

  2. fpga奇偶分频源代码实现 偶数倍分频：如进行N倍偶数分频，那么可以通过由待分频的时钟触发计数器计数，当计数器从0计数到N/2-1时，输出时钟进行翻转，并给计数器一个复位信号，使得下一个时钟从零开始计数。以此循环下去。这种方法可以实现任意的偶数分频。 奇数倍分频：归类为一般的方法为：对于实现占空比为50%的N倍奇数分频，首先进行上升沿触发进行模N计数，计数从零开始，到（N－1）/2进行输出时钟翻转，然后经过（N-1）/2再次进行翻转得到一个占空比非50%奇数n分频时钟。再者同时进行下降沿触发的

  3. 所属分类：硬件开发

    • 发布日期：2011-06-13
    • 文件大小：2048
    • 提供者：zhaoojingg

  1. 任意偶分频的和奇数分频的verilog HDL语言描述。

  2. 用verilog HDL实现的任意偶分频的，奇数分频的示例。记得用记事本打开。

  3. 所属分类：硬件开发

    • 发布日期：2012-08-13
    • 文件大小：937
    • 提供者：spritesyb

  1. 基于VHDL的任意奇偶分频

  2. 用VHDL写的任意数奇偶分频，下载到实验板上用过，完全好使

  3. 所属分类：专业指导

    • 发布日期：2008-12-19
    • 文件大小：885
    • 提供者：juhuanwen1

  1. VerilogHDL实现奇偶分频占空比

  2. 实现VerilogHDL奇偶分频，以及任意分频，并可以改变波形的占空比，中包含源代码以及测试代码testbench.

  3. 所属分类：硬件开发

    • 发布日期：2018-05-17
    • 文件大小：1048576
    • 提供者：qq_36215315

  1. Verilog搭建奇偶任意分频器

  2. 支持任意正整数分频，该算法为平均分频，奇偶分频占空比均为50%

  3. 所属分类：硬件开发

    • 发布日期：2019-01-30
    • 文件大小：2048
    • 提供者：atshenshilin

  1. DSP算法应用与设计(七).pdf.pdf

  2. DSP算法应用与设计(七).pdfpdf,DSP算法应用与设计(七).pdf342第二部分DSP算法工具萄 四点的DFT也享有两点DFT的无须乘法的特性。所以如果N是4的次方的话,可以采用听 请的基4算法。分解的办法和7.38小节肀的一样。和基2的情况一样,可以定义基4的蝶形结, 该蝶形结包括与旅转因子相乘的4点DFT。图732是基4蝶形结的图示。对于一个16点的DFT, 需要32个2点DFT,也可以只需要8个4点DFT还可以采用多基和混合基的FFT。但是由于对 可用N的限制以及速度提升得不明显

  3. 所属分类：其它

    • 发布日期：2019-09-14
    • 文件大小：5242880
    • 提供者：weixin_38743481

  1. USB单片机CH559模拟U盘应用实例-CH552DS1.PDF

  2. USB单片机CH559模拟U盘应用实例-CH552DS1.PDFCH552手册 3 引脚号 引脚其它功能名称 其它功能描述 TSS0P20S0P16M0P10名称(左侧功能优先) 9 VCC VDD 电源输入端,需要外接01F电源退耦电容 内部USB电源调整器输出和內部USB电源输入, 16 10V33 当电源电压小于3.6V时连接VGc输入外部电源, 当电源电压大于3.6V时外接0.1uF电源退耦电容 14 8 GND VSS 公共接地端 6 5RsT|RsT/T2 DEX/ CAP2后缀下划

  3. 所属分类：其它

    • 发布日期：2019-09-03
    • 文件大小：601088
    • 提供者：weixin_38743506

  1. USB单片机CH559模拟U盘应用实例-CH554DS1.PDF

  2. USB单片机CH559模拟U盘应用实例-CH554DS1.PDF54手册 3 引脚号 引脚其它功能名称 T0P0P16M0P10名称(左侧功能优先) 其它功能描述 9 VCC VDD 电源输入端,需要外接0.1uF电源退耦电容。 内部USB电源调整器输出和內部USB电源输入, 16 1033 当电源电压小于3.6V时连接Vc输入外部电源, 当电源电压大于3.6V时外接0.1uF电源退耦电容 18 14 GND VSS 公共接地端。 6 5|RsT| RST/T2EX/AP2后缀下划线的引脚是无下

  3. 所属分类：其它

    • 发布日期：2019-09-03
    • 文件大小：629760
    • 提供者：weixin_38743481

  1. divider_all.zip

  2. 本资源包含了divider_all和divider_all_tb两个.v文件，包含了奇偶分频（50%占空比）、任意占空比任意N分频、任意小数分频+N+0.5分频，相关原理性介绍详见本人博客——整数（奇偶）+分数分频器的verilog实现（大合集）

  3. 所属分类：硬件开发

    • 发布日期：2020-08-11
    • 文件大小：221184
    • 提供者：huigeyu