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  1. 基于模块化设计方法实现FPGA动态部分重构

  2. 本文以Xilinx FPGA为研究对象，介绍了采用模块化设计实现FPGA动态部分重构功能的方法。FPGA的动态部分重构功能使硬件设计更加灵活，可以将不同设计定位到芯片内同一逻辑资源部分，重构此部分逻辑资源，同时保持其他部分电路功能正常。

  3. 所属分类：其它

    • 发布日期：2020-08-07
    • 文件大小：84992
    • 提供者：weixin_38655780

  1. 基于模块化设计方法实现FPGA动态部分重构

  2. 本文针对Xilinx公司的FPGA进行研究，支持模块化动态部分重构的器件族有Virtex/-II/-E和Virtex-II Pro。 Xilinx公司FPGA是基于SRAM工艺的，包括配置逻辑块（CLBs），输入输出块（IOBs），块RAMs，时钟资源和编程布线等资源[2]。CLBs是构造用户所需逻辑的功能单元，IOBs提供封装引腿与内部信号引线的接口。可编程互连资源提供布线通道连接可配置元件的输入和输出到相应的网络。

  3. 所属分类：其它

    • 发布日期：2020-10-22
    • 文件大小：315392
    • 提供者：weixin_38563176

  1. 用模块化设计方法实现FPGA动态部分重构

  2. 基于FPGA动态可重构技术将设计从一个纯空间的数字逻辑系统转换为在时间、空间混合构建的数字逻辑系统。这种技术是数字系统设计方法、 设计思想的变革，使FPGA资源利用率成倍提高。目前我国在FPGA可重构技术方面开展的研究很少。本论文阐述了采用模块化设计实现FPGA动态部分重构 的方法，能够使FPGA部分逻辑功能重新配置过程中，其余部分逻辑功能正常运行，即实现了FPGA逻辑功能的动态部分重构。

  3. 所属分类：其它

    • 发布日期：2020-10-18
    • 文件大小：360448
    • 提供者：weixin_38516190

  1. EDA/PLD中的基于模块化设计方法实现FPGA动态部分重构

  2. 摘要：介绍了Xilinx FPGA的配置原理和FPGA模块化设计流程以及划分重构模块的原则。通过一个实例介绍了采用模块化设计方法实现Virtex-E FPGA动态部分重构的过程，能使重构模块在系统运行时改变其逻辑功能，而固定模块逻辑功能不中断，同时器件的重构时间大大减少。 　　随着可编程技术的不断发展，FPGA被广泛应用于电子设计的各个领域。新的设计思想和设计方法也被不断的提出和应用，如FPGA的动态部分重构技术。所谓动态重构是指对于时序变化的数字逻辑系统，其时序逻辑的发生，不是通过调用芯片内

  3. 所属分类：其它

    • 发布日期：2020-11-06
    • 文件大小：244736
    • 提供者：weixin_38599537

  1. 基于模块化设计方法实现FPGA动态部分重构

  2. 摘要：介绍了Xilinx FPGA的配置原理和FPGA模块化设计流程以及划分重构模块的原则。通过一个实例介绍了采用模块化设计方法实现Virtex-E FPGA动态部分重构的过程，能使重构模块在系统运行时改变其逻辑功能，而固定模块逻辑功能不中断，同时器件的重构时间大大减少。 　　随着可编程技术的不断发展，FPGA被广泛应用于电子设计的各个领域。新的设计思想和设计方法也被不断的提出和应用，如FPGA的动态部分重构技术。所谓动态重构是指对于时序变化的数字逻辑系统，其时序逻辑的发生，不是通过调用芯片内

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：351232
    • 提供者：weixin_38501610