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  1. 基于FPGA的数字秒表的VHDL设计

  2. 【摘要】文章介绍了用于体育比赛的数字秒表的VHDL 设计, 并基于FPGA 在MAXPLUS2 软件下, 采用ALTRA 公司FLEX10K 系列的EPF10K10LC84- 4 芯片进行了计算机仿真。 【关键词】FPGA; 数字秒表; VHDL

  3. 所属分类：硬件开发

    • 发布日期：2010-01-11
    • 文件大小：97280
    • 提供者：semi704

  1. 基于FPGA的数字秒表的VHDL设计

  2. 本文包含基于FPGA使用VHDL语言设计秒表的源代码以及作品总结文档，是本人在全国大学生电子设计大赛前的实训时的作品。

  3. 所属分类：硬件开发

    • 发布日期：2010-05-01
    • 文件大小：111616
    • 提供者：yake1987

  1. 图像处理实验参考报告（电信狂人版）

  2. 基于FPGA的数字秒表的设计 其中有设计框图，功能说明，源程序，仿真图 总之，适合课程设计的人作参考

  3. 所属分类：嵌入式

    • 发布日期：2010-05-15
    • 文件大小：698368
    • 提供者：onging001

  1. 基于FPGA的数字秒表设计

  2. 本科生毕业论文(设计)开题报告书 题 目： 基于FPGA的数字秒表设计 学生姓名： *********** 学 号： ********** 专业班级： 自动化******班 指导老师： ************ 2010年 3 月 20 日 论文（设计）题目 ISP技术及其应用研究 课题目的、意义及相关研究动态： 课题设计的主要目的：运用所学的数字电子技术的基本知识和数字电子电路的设计方法，将数字电子技术的基础知识与EDA技术有机地联系起来，EDA电子仿真软件的仿真功能强大，具有完备的文件库，

  3. 所属分类：嵌入式

    • 发布日期：2010-06-16
    • 文件大小：747520
    • 提供者：sanpao2010

  1. 基于FPGA的数字秒表的VHDL设计

  2. 介绍了用于体育比赛的数字秒表的VHDL设计，并基于FPGA在MAXPLUS2软件下，采用ALTRA公司FLEX10K系列的EPF10KLC84-4芯片进行计算机仿真。

  3. 所属分类：嵌入式

    • 发布日期：2010-10-25
    • 文件大小：97280
    • 提供者：c0121

  1. 基于FPGA的数字秒表的VHDL设计

  2. 基于基于FPGA的数字秒表的VHDL设计基于FPGA的数字秒表的VHDL设计基于FPGA的数字秒表的VHDL设计

  3. 所属分类：硬件开发

    • 发布日期：2010-12-29
    • 文件大小：97280
    • 提供者：phy163

  1. 基于FPGA的数字秒表设计

  2. 基于FPGA的数字秒表设计，运用VHDL语言，程序代码，调试成功

  3. 所属分类：硬件开发

    • 发布日期：2010-12-30
    • 文件大小：1048576
    • 提供者：imie321

  1. 一种新型的FPGA数字秒表设计

  2. 基于VHDL语言的数字秒表设计 节省资源 时间更适合在实验室开发应用 欢迎大家来使用下载

  3. 所属分类：硬件开发

    • 发布日期：2011-03-03
    • 文件大小：143360
    • 提供者：ma36524555

  1. 基于FPGA的秒表文献综述

  2. 基于FPGA的秒表文献综述.借助FPGA实现数字秒表的设计，充分体现了现代数字电路设计新系统芯片化，芯片化设计的思想突破了传统电子系统的设计模式，使系统开发速度快、成本低、系统性能大幅度地提升。应用VHDL语言设计数字系统，很多设计工作可以在计算机上完成，从而缩短了系统的开发时间，提高了工作效率。本文介绍一种以FPGA为核心，以VHDL为开发工具的数字秒表。

  3. 所属分类：硬件开发

    • 发布日期：2011-05-22
    • 文件大小：64512
    • 提供者：later928

  1. EDA/SOPC 技术实验讲义

  2. 第一章 EDA_VHDL 实验/设计与电子设计竞赛 4 1-1、 应用QuartusII 完成基本组合电路设计 5 1-2. 应用QuartusII 完成基本时序电路的设计 6 1-3. 设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图输入法设计8 位全加器 11 1-9. 在Quartu

  3. 所属分类：硬件开发

    • 发布日期：2012-04-18
    • 文件大小：3145728
    • 提供者：xiaosong89

  1. 基于FPGA的数字秒表的设计

  2. 有原理图和仿真图，绝对实用的东西，免费的还不来下

  3. 所属分类：嵌入式

    • 发布日期：2009-04-19
    • 文件大小：331776
    • 提供者：jiapangbo111

  1. FPGA-verilog秒表设计

  2. 基于FPGA的秒表设计代码及解释，使用Verilog编写，对学习数字电路的同学有所帮助

  3. 所属分类：其它

    • 发布日期：2018-12-13
    • 文件大小：51200
    • 提供者：qq_41303566

  1. 一种基于FPGA的数字秒表设计方法

  2. 文中介绍了一种基于FPGA的数字秒表设计方法。采用VHDL硬件描述语言， 运用ModelSim等EDA仿真工具。该设计具有外围电路少、集成度高、可靠性强等优点。最后经实验验证， 该数字秒表计时准确， 输入信号能准确控制秒表运行。系统所采用的自上而下的模块化设计方法， 对于其他复杂的系统设计也有很强的借鉴意义。

  3. 所属分类：其它

    • 发布日期：2020-08-05
    • 文件大小：83968
    • 提供者：weixin_38590520

  1. 嵌入式系统/ARM技术中的基于FPGA的数字秒表设计与仿真

  2. 数字集成电路作为当今信息时代的基石，不仅在信息处理、工业控制等生产领域得到普及应用，并且在人们的日常生活中也是随处可见，极大的改变了人们的生活方式。面对如此巨大的市场，要求数字集成电路的设计周期尽可能短、实验成本尽可能低，最好能在实验室直接验证设计的准确性和可行性，因而出现了现场可编程逻辑门阵列FPGA.对于芯片设计而言，FPGA的易用性不仅使得设计更加简单、快捷，并且节省了反复流片验证的巨额成本。对于某些小批量应用的场合，甚至可以直接利用FPGA实现，无需再去订制专门的数字芯片。 　　文中着

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：173056
    • 提供者：weixin_38613681

  1. 单片机与DSP中的基于ADPCM的数字语音存储与回放系统设计方案（二）

  2. 4 程序设计 　　系统软件部分由单片机的C51语言和FPGA的Ver-ilogHDL语言组成。其中，单片机主要完成用户输入输出处理和系统的控制，FPGA主要完成需要严格时序控制（如数据采集、频谱显示）以及大规模数据计算（如FFT、ADPCM 编码）等。整个系统的设计中模块化思想贯穿始终，采用菜单键选择所用功能，系统流程图如图10 所示。 　　 　　5方案测试与结果 　　5.1 测试仪器 　　测试仪器包括直流稳压稳流电源，型号为SG1733SB3A;60M 数字存储示波器，型号为Tekt

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：123904
    • 提供者：weixin_38732519

  1. 基于FPGA的数字秒表设计与仿真

  2. 数字集成电路作为当今信息时代的基石，不仅在信息处理、工业控制等生产领域得到普及应用，并且在人们的日常生活中也是随处可见，极大的改变了人们的生活方式。面对如此巨大的市场，要求数字集成电路的设计周期尽可能短、实验成本尽可能低，最好能在实验室直接验证设计的准确性和可行性，因而出现了现场可编程逻辑门阵列FPGA。

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：131072
    • 提供者：weixin_38624557

  1. 基于FPGA的数字秒表设计与实现

  2. 在Quartus II软件平台的基础上，基于VHDL语言及图形输入，采用FPGA设计了一款数字秒表，同时，给出了数字秒表系统设计方案及各个功能模块的设计原理。通过对系统进行编译、仿真，并下载到Cyclone系列EP2C5Q208C8器件中进行测试，结果表明，本设计能实现计时显示、启停、复位及计时溢出报警功能。

  3. 所属分类：其它

    • 发布日期：2020-10-17
    • 文件大小：215040
    • 提供者：weixin_38608866

  1. EDA/PLD中的基于FPGA的数字秒表的设计

  2. 应用VHDL语言设计数字系统，很多设计工作可以在计算机上完成，从而缩短了系统的开发时间，提高了工作效率。本文介绍一种以FPGA为核心，以VHDL为开发工具的数字秒表，并给出源程序和仿真结果。 　　1 系统设计方案 　　1．1 系统总体框图 　　数字秒表主要有分频器、计数模块、功能控制模块、势能控制模块和显示输出模块组成。系统框图如图1所示。 　　本次的设计仿真选用以EPlC6Q240芯片为核心的FPGA开发板，该开发板提供了较完善的外围周边电路和信号接口，并提供了一块4位7段数码

  3. 所属分类：其它

    • 发布日期：2020-11-09
    • 文件大小：342016
    • 提供者：weixin_38741195

  1. 基于FPGA的数字秒表的设计

  2. 应用VHDL语言设计数字系统，很多设计工作可以在计算机上完成，从而缩短了系统的开发时间，提高了工作效率。本文介绍一种以FPGA为，以VHDL为开发工具的数字秒表，并给出源程序和仿真结果。 　　1 系统设计方案 　　1．1 系统总体框图 　　数字秒表主要有分频器、计数模块、功能控制模块、势能控制模块和显示输出模块组成。系统框图如图1所示。 　　本次的设计仿真选用以EPlC6Q240芯片为的FPGA开发板，该开发板提供了较完善的外围周边电路和信号接口，并提供了一块4位7段数码管的扩展

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：501760
    • 提供者：weixin_38506138

  1. 基于FPGA的数字秒表设计与仿真

  2. 数字集成电路作为当今信息时代的基石，不仅在信息处理、工业控制等生产领域得到普及应用，并且在人们的日常生活中也是随处可见，极大的改变了人们的生活方式。面对如此巨大的市场，要求数字集成电路的设计周期尽可能短、实验成本尽可能低，能在实验室直接验证设计的准确性和可行性，因而出现了现场可编程逻辑门阵列FPGA.对于芯片设计而言，FPGA的易用性不仅使得设计更加简单、快捷，并且节省了反复流片验证的巨额成本。对于某些小批量应用的场合，甚至可以直接利用FPGA实现，无需再去订制专门的数字芯片。 　　文中着重介

  3. 所属分类：其它

    • 发布日期：2021-01-19
    • 文件大小：162816
    • 提供者：weixin_38720050
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