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搜索资源列表

  1. 高速设计的板级信号处理(上).pdf

  2. 高速数字系统的振铃和串扰问题一直是一个令人头疼的问题，特别是在今 天，越来越多的VLSI芯片工作在100MHz的频率以上，450MHz的CPU也将广泛 应用，信号的边沿越来越陡（已达到ps级），这些高速器件性能的增加也给高 速系统设计带来了困难。同时，高速系统的体积不断减小使得印制板的密度迅速 提高。比较现在新的PC主板与几年前的主板，可以看到新的主板上加入了许多 端接。信号完整性问题已经成为新一代高速产品设计中越来越值得注意的问题， 这已是毋庸置疑的了。

  3. 所属分类：嵌入式

    • 发布日期：2009-06-04
    • 文件大小：261120
    • 提供者：shijizhen123

  1. 数字电路的基础知识教程

  2. 数字系统设计基础教程将数字系统作为一个整体的系统，并按层次结构对数字系统进行划分和论述。论题涉及了数字系统技术的各个方面，如：数制、编码、布尔代数、逻辑门、组合逻辑设计、时序电路、VHDL基本概念、VLSI设计基本概念、CMOS逻辑电路和硅芯片、存储器部件、计算机原理和计算机体系结构基础知识等等。本书将传统的数字电路知识和现代技术相结合，适于大专院校相关专业的学生作教科书之用

  3. 所属分类：嵌入式

    • 发布日期：2009-10-27
    • 文件大小：1048576
    • 提供者：username2009

  1. Digital Signal Processing in VLSI

  2. 一本关于芯片设计里面的数字信号处理外文书

  3. 所属分类：嵌入式

    • 发布日期：2010-10-07
    • 文件大小：5242880
    • 提供者：huaer448

  1. 超大规模集成电路与系统导论

  2. 超大规模集成电路与系统导论 本书介绍数字VLSI芯片设计基础

  3. 所属分类：硬件开发

    • 发布日期：2012-10-04
    • 文件大小：17825792
    • 提供者：hefei_wh_ht

  1. Verilog数字VLSI设计教程

  2. 这个资料是进行芯片设计所用编程语言verilog学习非常好的一本书，希望对大家有帮助。

  3. 所属分类：硬件开发

    • 发布日期：2012-11-10
    • 文件大小：39845888
    • 提供者：huallin000111

  1. 数字VLSI芯片设计.z01

  2. 资源太大，只能分开上传，一共五个文件压缩包，pdf添加了书签

  3. 所属分类：嵌入式

    • 发布日期：2012-12-04
    • 文件大小：41943040
    • 提供者：z35253215

  1. 数字VLSI芯片设计.z02

  2. 资源太大，只能分开上传，一共五个文件压缩包，pdf添加了书签

  3. 所属分类：嵌入式

    • 发布日期：2012-12-04
    • 文件大小：41943040
    • 提供者：z35253215

  1. 数字VLSI芯片设计.z03

  2. 数字VLSI芯片设计，中文版的，一共5个压缩包，pdf有书签。

  3. 所属分类：嵌入式

    • 发布日期：2012-12-04
    • 文件大小：41943040
    • 提供者：z35253215

  1. 数字VLSI芯片设计.z04

  2. 数字VLSI芯片设计，中文版的，一共5个压缩包，pdf有书签。

  3. 所属分类：嵌入式

    • 发布日期：2012-12-04
    • 文件大小：41943040
    • 提供者：z35253215

  1. 数字VLSI芯片设计.zip

  2. 数字VLSI芯片设计，中文版的，一共5个压缩包，pdf有书签。

  3. 所属分类：嵌入式

    • 发布日期：2012-12-04
    • 文件大小：28311552
    • 提供者：z35253215

  1. 超大规模集成电路与系统导论

  2. 周润德翻译的版本，本书介绍数字VLSI芯片设计的基础。重点介绍如何将一个系统的设计要求转移到一个小硅片上。

  3. 所属分类：专业指导

    • 发布日期：2013-04-03
    • 文件大小：17825792
    • 提供者：henry547

  1. 基于单片VLSI的边界扫描主控器的设计与实现

  2. 针对边界扫描主控器常规实现方案执行速度慢,与通用处理器配合的专用边界扫描接口芯片仍然是依靠处理器运行边界扫描软件,测试速度不高,设计灵活性受到了接口芯片的限制的问题,提出了一种基于VHDL语言描述、FPGA实现的边界扫描主控器的硬件实现方法,设计了边界扫描主控器的基本结构,完成了主控器的VHDL模块化设计,并通过Quartus II开发平台,对各模块进行时序与功能仿真,实现了边界扫描主控器的单片集成。结果表明:用FPGA实现边界扫描主控器,时序验证方便,测试码加载速度快,修改灵活、系统集成度高,

  3. 所属分类：其它

    • 发布日期：2020-06-23
    • 文件大小：587776
    • 提供者：weixin_38689824

  1. 系统芯片nRF24E1及其在无绳电话中的应用

  2. nRF24E1收发器和nRF24E2发射器是Nordic VLSI推出的两种系统级芯片，采用先进的0。18μs CMOS工艺、6mm×6mm的36引脚QFN封装；以nRF2401/02芯片结构为基础，将射频、8051MCU、9输入12位ADC、125通道、 UART、SPI、PWM、RTC、WDT全部集成到单芯片中；内部有电压高速器和VDD电压监视。nRF24E1/nRF24E2适用于无线鼠标和键盘、无线手持终端、无线频率识别、数字视频、遥控和汽车电子及其它短距离无线高速应用。

  3. 所属分类：其它

    • 发布日期：2020-07-08
    • 文件大小：35840
    • 提供者：weixin_38681218

  1. 数字IC设计相关经典pdf英文合集

  2. 1、经典人手verilog设计pdf： Michael D. Ciletti Advanced Digital Design With the Verilog HDL 2、Digital Integrated Circuits by Jan M. Rabaey 3、经典DC综合中文总结pdf: 高级ASIC芯片综合 4、经典STA静态时序分析pdf: Static Timing Analysis for Nanometer Designs 5、CMOS VLSI Design A Circui

  3. 所属分类：电信

    • 发布日期：2020-10-05
    • 文件大小：149946368
    • 提供者：sinat_36752903

  1. 基于单芯片的GPS接收机硬件设计

  2. 引言 　　GPS(全球定位系统)发展到今天，其用途越来越广泛，而技术的进步和用户需求也不断推动GPS系统的增强。目前美国正在致力于GPS Block II系统的现代化和“GPS - III”计划，旨在全面改善GPS的生命力、精度、可用性、完好性、灵活性和安全性。 　　GPS用户端设备也处于不断升级和发展之中。从接收机的结构来看，随着VLSI(超大规模集成电路)和DSP技术的发展,单通道序贯式、时分多路复用式接收机早已被采用DSP模块的并行多通道接收机所代替，所能达到的通道数和等效相关器数不

  3. 所属分类：其它

    • 发布日期：2020-10-20
    • 文件大小：152576
    • 提供者：weixin_38565801

  1. PCB技术中的集成芯片内电容

  2. 现代微处理器、数字信号处理器和专用集成电路等技术的飞速发展，已成为电磁干扰的主要来源。如今 的主要辐射源不再是由不合理的步线、板结构、阻抗失配或电源不稳定原因所产生。器件的工作频率已从 20～50 MHz发展到了200～5000 MHz，甚至更高。随着时钟频率的提升，每个VLSI器件存在切换电流，切 换电流的傅里叶频谱产生RF能量，使得数字器件必然会存在辐射。 　　现代集成电路工艺的发展使得上百万的晶体管被集成到一块小硅片上，生产工艺达到了0.18 μm线宽 。虽然硅片尺寸不断收缩，但元件数量

  3. 所属分类：其它

    • 发布日期：2020-11-16
    • 文件大小：113664
    • 提供者：weixin_38623080

  1. 电子测量中的基于边界扫描技术的数字系统测试研究

  2. 当今，微电子技术已经进入超大规模集成电路(VLSI)时代。随着芯片电路的小型化及表面封装技术(SMT)和电路板组装技术的发展，使得传统测试技术面临着巨大的挑战。在这种情况下，为了提高电路和系统的可测试性，联合测试行动小组(JTAG)于1987年提出了一种新的电路板测试方法--边界扫描测试，并于1990年被IEEE接纳，形成了IEEE1149．1标准，也称为JTAG标准[1]。这种技术以全新的"虚拟探针"代替传统的"物理探针"来提高电路和系统的可测性。由于JTAG标准的通用性很好，现在许多IC公司

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：233472
    • 提供者：weixin_38719475

  1. 基于数字极性相关算法的激光脉冲测距

  2. 与直接阈值检测相比,采用数字相关技术是提高激光脉冲测距系统灵敏度的有效途径。引入数字极性相关算法,可以有效地减少相关函数处理所需的硬件支出,在单个超大规模集成电路(VLSI)芯片上实现并行的相关运算,提高数据吞吐量。通过仿真计算验证了此数字极性相关系统在弱信号激光测距中的效果,分析了脉冲重复频率、起始处延时、脉冲间隔抖动、脉冲宽度以及采样频率对输出结果的影响,为设计适用于数字相关检测的激光光源提供了理论依据。

  3. 所属分类：其它

    • 发布日期：2021-02-11
    • 文件大小：435200
    • 提供者：weixin_38626858

  1. 基于单芯片的GPS接收机硬件设计

  2. 引言 　　GPS(定位系统)发展到今天，其用途越来越广泛，而技术的进步和用户需求也不断推动GPS系统的增强。目前美国正在致力于GPS Block II系统的现代化和“GPS - III”计划，旨在全面改善GPS的生命力、精度、可用性、完好性、灵活性和安全性。 　　GPS用户端设备也处于不断升级和发展之中。从接收机的结构来看，随着VLSI(超大规模集成电路)和DSP技术的发展,单通道序贯式、时分多路复用式接收机早已被采用DSP模块的并行多通道接收机所代替，所能达到的通道数和等效相关器数不断增

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：166912
    • 提供者：weixin_38667403

  1. 集成芯片内电容

  2. 现代微处理器、数字信号处理器和专用集成电路等技术的飞速发展，已成为电磁干扰的主要。如今 的主要辐射源不再是由不合理的步线、板结构、阻抗失配或电源不稳定原因所产生。器件的工作频率已从 20～50 MHz发展到了200～5000 MHz，甚至更高。随着时钟频率的提升，每个VLSI器件存在切换电流，切 换电流的傅里叶频谱产生RF能量，使得数字器件必然会存在辐射。 　　现代集成电路工艺的发展使得上百万的晶体管被集成到一块小硅片上，生产工艺达到了0.18 μm线宽 。虽然硅片尺寸不断收缩，但元件数量增加

  3. 所属分类：其它

    • 发布日期：2021-01-20
    • 文件大小：132096
    • 提供者：weixin_38743084
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