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  1. 高斯白噪声序列的产生

  2. 高斯白噪声序列的产生,用vc实现。采用瑞利分布和中心极限定理分别实现。需要的就来下啊。
  3. 所属分类:C++

    • 发布日期:2009-09-21
    • 文件大小:46080
    • 提供者:peter_zuo
  1. 关于信道中高斯白噪声的几个特点

  2. 仿真通信系统时,由系统频带 E b/n 0到离散噪声序列方差的推算是正确建模的关键。而频带 Eb /n 0、基带 Eb /n 0、频带 SNR 、基带 SNR 等相互间的关系难以精确把握;从频带到基带,从连续到离散的变换又容易让人模糊。该文阐明了这些概念间的相互关系,给出了从频带 Eb /n 0到离散噪声序列方差的详细推演过程。
  3. 所属分类:嵌入式

    • 发布日期:2010-06-07
    • 文件大小:264192
    • 提供者:hxl990205
  1. 高斯白噪声序列的产生-使用瑞利分布 VC

  2. 在C环境下,实现高斯白噪声序列的产生,使用瑞利分布
  3. 所属分类:C++

  1. 用FPGA产生高斯白噪声序列的一种快速方法

  2. 用FPGA产生高斯白噪声序列的一种快速方法
  3. 所属分类:嵌入式

    • 发布日期:2011-08-18
    • 文件大小:246784
    • 提供者:liuchunjinglcc
  1. 用FPGA产生高斯白噪声序列的一种快速方法

  2. 介绍了用FPGA快速产生高斯白噪声序列的方法、原理和实现步骤。根据均匀分布和高斯分布之间的映射关系,提出了适合在FPGA中实现的折线逼近方法 (以折线逼近映射关系曲线), 从而实现了高斯白噪声序列的快速实时生成。
  3. 所属分类:电信

    • 发布日期:2012-02-29
    • 文件大小:331776
    • 提供者:kangganrao
  1. 产生正态白噪声序列(1) 打印出前50个数 ⑵分布检验⑶均值检验⑷方差检验

  2. 产生正态白噪声序列(1) 打印出前50个数 ⑵分布检验⑶均值检验⑷方差检验 ⑸计算(画图)
  3. 所属分类:软件测试

    • 发布日期:2012-11-06
    • 文件大小:47104
    • 提供者:li0lei
  1. 高斯白噪声序列的产生-使用瑞利分布 VC

  2. 在C环境下,实现高斯白噪声序列的产生,使用瑞利分布
  3. 所属分类:C/C++

    • 发布日期:2013-04-09
    • 文件大小:974848
    • 提供者:leocfyb
  1. 在C环境下,实现高斯白噪声序列的产生,使用瑞利分布

  2. 高斯白噪声序列的产生-使用瑞利分布 VC 高斯噪声.用c/c++完成一个幅度为0.5,频率范围500Hz-1500Hz的带通离散白噪声的产生
  3. 所属分类:C++

    • 发布日期:2018-03-15
    • 文件大小:337920
    • 提供者:q742142041
  1. 白噪声和M序列的生成

  2. 高斯白噪声和M序列的生成,用于系统辨识的输入信号,MATLAB编程实现
  3. 所属分类:讲义

    • 发布日期:2018-04-08
    • 文件大小:1024
    • 提供者:weixin_40279988
  1. 生成高斯白噪声,应用于图像处理

  2. 生成高斯白噪声序列,包括使用瑞利分布和中心极限定理!
  3. 所属分类:图像处理

    • 发布日期:2019-03-05
    • 文件大小:77824
    • 提供者:qq_35459713
  1. 高斯白噪声.rar

  2. 该程序可生成高斯白噪声序列,可改变均值sigma和序列长度size。
  3. 所属分类:C

    • 发布日期:2019-07-15
    • 文件大小:20480
    • 提供者:qq_36428459
  1. 使用python实现时间序列白噪声检验方式

  2. 主要介绍了使用python实现时间序列白噪声检验方式,具有很好的参考价值,希望对大家有所帮助。一起跟随小编过来看看吧
  3. 所属分类:其它

    • 发布日期:2020-09-16
    • 文件大小:91136
    • 提供者:weixin_38704835
  1. 基于伪噪声序列的OFDM信道估计方法

  2. 针对正交频分复用(Orthogonal Frequency Division Multiplexing,OFDM)的应用及需求,提出一种基于伪噪声(pseudo-noise)序列的OFDM系统模型,并针对其信道估计均衡需求,提出一种基于迭代的信道估计算法和低复杂度的频域均衡算法。最后在高斯白噪声信道、存在多普勒频移瑞利信道、双径延迟信道下,对误码率性能进行仿真和分析。结果表明,该方法适用于常见信道,误码率性能优于传统循环前缀(Cyclic Prefix,CP)OFDM,且通过迭代能够提高性能。以
  3. 所属分类:其它

    • 发布日期:2020-10-17
    • 文件大小:464896
    • 提供者:weixin_38557757
  1. EDA/PLD中的用FPGA产生高斯白噪声序列的一种快速方法

  2. 0 引言   短波信道存在多径时延、多普勒频移和扩散、高斯白噪声干扰等复杂现象。为了测试短波通信设备的性能,通常需要进行大量的外场实验。相比之下,信道模拟器能够在实验室环境下进行类似的性能测试,而且测试费用少、可重复性强,可以缩短设备的研制周期。所以自行研制信道模拟器十分必要。   信道模拟器可选用比较有代表性的 Watterson 信道模型 ( 即高斯散射增益抽头延迟线模型 ) ,其中一个重要环节就是快速产生高斯白噪声序列,便于在添加多普勒扩展和高斯白噪声影响时使用。传统的高斯白噪声发生器
  3. 所属分类:其它

    • 发布日期:2020-11-09
    • 文件大小:299008
    • 提供者:weixin_38718434
  1. 利用python实现平稳时间序列的建模方式

  2. 一、平稳序列建模步骤 假如某个观察值序列通过序列预处理可以判定为平稳非白噪声序列,就可以利用ARMA模型对该序列进行建模。建模的基本步骤如下: (1)求出该观察值序列的样本自相关系数(ACF)和样本偏自相关系数(PACF)的值。 (2)根据样本自相关系数和偏自相关系数的性质,选择适当的ARMA(p,q)模型进行拟合。 (3)估计模型中位置参数的值。 (4)检验模型的有效性。如果模型不通过检验,转向步骤(2),重新选择模型再拟合。 (5)模型优化。如果拟合模型通过检验,仍然转向不走(2),充分考虑
  3. 所属分类:其它

    • 发布日期:2020-12-17
    • 文件大小:74752
    • 提供者:weixin_38532629
  1. 使用python实现时间序列白噪声检验方式

  2. 白噪声检验也称为纯随机性检验, 当数据是纯随机数据时,再对数据进行分析就没有任何意义了, 所以拿到数据后最好对数据进行一个纯随机性检验 acorr_ljungbox(x, lags=None, boxpierce=False) # 数据的纯随机性检验函数 lags为延迟期数,如果为整数,则是包含在内的延迟期数,如果是一个列表或数组,那么所有时滞都包含在列表中最大的时滞中 boxpierce为True时表示除开返回LB统计量还会返回Box和Pierce的Q统计量 返回值: lbvalue:测试
  3. 所属分类:其它

    • 发布日期:2020-12-17
    • 文件大小:51200
    • 提供者:weixin_38522253
  1. 使用python实现时间序列白噪声检验方式

  2. 白噪声检验也称为纯随机性检验, 当数据是纯随机数据时,再对数据进行分析就没有任何意义了, 所以拿到数据后最好对数据进行一个纯随机性检验 acorr_ljungbox(x, lags=None, boxpierce=False) # 数据的纯随机性检验函数 lags为延迟期数,如果为整数,则是包含在内的延迟期数,如果是一个列表或数组,那么所有时滞都包含在列表中最大的时滞中 boxpierce为True时表示除开返回LB统计量还会返回Box和Pierce的Q统计量 返回值: lbvalue:测试
  3. 所属分类:其它

    • 发布日期:2020-12-17
    • 文件大小:51200
    • 提供者:weixin_38633157
  1. 基于FPGA的高斯白噪声发生器设计

  2. 高斯白噪声发生器用于雷达系统和通信信道的测试,采用现场可编程门阵列(FPGA)实现噪声发生器的设计,在Altera公司的QuartusⅡ软件环境下,进行模块化设计方案,将FPGA实现的功能分为m序列产生模块、FIR数字滤波器模块、DDS模块和合成模块四个主要功能性模块,详细分析了m序列发生算法、FIR滤波算法和DDS算法。应用VHDL语言实现模块功能性设计。该系统采用CycloneⅡ芯片EP2C8N,输出噪声带宽可调,计算量小,可重复性好。
  3. 所属分类:其它

    • 发布日期:2021-02-23
    • 文件大小:296960
    • 提供者:weixin_38516804
  1. 用CPLD实现的数字式白噪声发生器

  2. 摘要:分析了m序列发生器的统计特性,根据信噪比要求引出了方差公式,提出了可调方差的实现方法,并针对硬件特点提出了插值法以简化运算,最后用CPLD实现了白噪声发生器。关键词:白噪声发生器;CPLD;信噪比;m序列引言---噪声在自然界中是无处不在的,特别是在工业控制、测量以及电子通信等工程领域,普遍存在着白噪声,对实际应用造成了严重的危害。为了克服白噪声的影响,在使用前要对设备进行抗噪声模拟,因此需要通过人工方式产生白噪声。产生白噪声的方法有多种,目前常用计算机编程产生,然后由串口输出,由于串口只
  3. 所属分类:其它

    • 发布日期:2021-02-03
    • 文件大小:108544
    • 提供者:weixin_38579899
  1. 用FPGA产生高斯白噪声序列的一种快速方法

  2. 0 引言   短波信道存在多径时延、多普勒频移和扩散、高斯白噪声干扰等复杂现象。为了测试短波通信设备的性能,通常需要进行大量的外场实验。相比之下,信道模拟器能够在实验室环境下进行类似的性能测试,而且测试费用少、可重复性强,可以缩短设备的研制周期。所以自行研制信道模拟器十分必要。   信道模拟器可选用比较有代表性的 Watterson 信道模型 ( 即高斯散射增益抽头延迟线模型 ) ,其中一个重要环节就是快速产生高斯白噪声序列,便于在添加多普勒扩展和高斯白噪声影响时使用。传统的高斯白噪声发生器
  3. 所属分类:其它

    • 发布日期:2021-01-19
    • 文件大小:416768
    • 提供者:weixin_38538021
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