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搜索资源列表

  1. 跨越鸿沟_同步世界中的异步信号(中英文)

  2. 只有最初级的逻辑电路才使用单一的时钟。大多数与数据传输相关的应用都有与生俱来的挑战，即跨越多个时钟域的数据移动，例如磁盘控制器、CDROM/DVD 控制器、调制解调器、网卡以及网络处理器等。当信号从一个时钟域传送到另一个时钟域时，出现在新时钟域的信号是异步信号。 　　在现代 IC、 ASIC 以及 FPGA 设计中，许多软件程序可以帮助工程师建立几百万门的电路，但这些程序都无法解决信号同步问题。设计者需要了解可靠的设计技巧，以减少电路在跨时钟域通信时的故障风险。

  3. 所属分类：网络基础

    • 发布日期：2009-06-11
    • 文件大小：349184
    • 提供者：downno

  1. 数字电路设计中跨时钟域信号同步

  2. 数字电路设计中跨时钟域信号同步处理（英文的）。

  3. 所属分类：专业指导

    • 发布日期：2009-11-15
    • 文件大小：623616
    • 提供者：botaizi

  1. FPGA跨时钟域设计

  2. FPGA跨时钟域设计的经典资料，详细讲了跨时钟域问题产生的原因和单个信号及多信号的跨时钟域数据同步的处理方式。

  3. 所属分类：硬件开发

    • 发布日期：2011-11-27
    • 文件大小：623616
    • 提供者：wuliao311

  1. 跨时钟域信号同步解决方案

  2. 跨时钟域信号同步解决方案

  3. 所属分类：硬件开发

    • 发布日期：2014-06-26
    • 文件大小：1048576
    • 提供者：wangyanchao151

  1. 跨时钟域信号同步方法6种

  2. 讲述在IC设计中，跨时钟域信号同步方法6种

  3. 所属分类：硬件开发

    • 发布日期：2016-03-10
    • 文件大小：297984
    • 提供者：fjelly

  1. 跨时钟域信号同步的IP解决方案

  2. 本文描述了对于FPGA编程实现中跨时钟域信号的处理方法

  3. 所属分类：硬件开发

    • 发布日期：2017-06-09
    • 文件大小：1048576
    • 提供者：qq_26657811

  1. 跨时钟域信号同步的IP解决方案

  2. 详细介绍了跨时钟域的信号同步怎么处理，提供了几种有效的解决方案，以供参考

  3. 所属分类：电信

    • 发布日期：2018-10-01
    • 文件大小：1048576
    • 提供者：qq_40309906

  1. FPGA设计中跨时钟域信号同步方法

  2. 随着 FPGA 系统设计的复杂化， 系统内部的各个功能模块往往需要工作在不同频率的异步时钟域中， 因此系统内核心功能模块与外设的通信设计无法避免地会涉及到跨时钟域的数据与信号的传递问题 尽管跨时钟域的同步问题并不属于 FPGA 系统设计领域的新问题， 但是随着多时钟域系统的常见化和复杂化， 使得跨时钟域同步这一要求具备了新的重要意义 在对跨时钟域设计中容易出现的亚稳态现象及其造成的影响进行简要概述与分析的基础上， 为了减小亚稳态发生的概率和降低系统对亚稳态错误的敏感程度， 提出了四种跨时钟域同步

  3. 所属分类：硬件开发

    • 发布日期：2018-09-12
    • 文件大小：503808
    • 提供者：hzn_0723

  1. 多时钟系统下跨时钟域同步电路的设计

  2. 针对当前 SOC 内部时钟越来越复杂 接口越来越多以及亚稳态 漏信号等常见的各种问题 分析了以往的优化方法的优缺点 然后从电路的角度出发 提出了一种新的 SOC 跨时钟域同步电路设计的方法 这种方法电路简单可靠性高 通过仿真实验和实测实验验证 能够在多时钟系统中适应最小输入脉宽 不漏信号 避免误触发和多触发 且很好地解决了亚稳态等问题

  3. 所属分类：硬件开发

    • 发布日期：2018-09-12
    • 文件大小：490496
    • 提供者：hzn_0723

  1. 单bit信号跨时钟域的方法：电平同步器+边沿同步器+脉冲同步器

  2. 单bit信号跨时钟域的三种方法，电平同步器+边沿同步器+脉冲同步器 包含设计代码与测试代码，欢迎反馈

  3. 所属分类：其它

    • 发布日期：2019-08-13
    • 文件大小：2048
    • 提供者：u013668469

  1. 基于FPGA的跨时钟域信号处理同步设计的重要.pdf

  2. 上次提出了一个处于异步时钟域的MCU与FPGA直接通信的实现方式，其实在这之前，特权同学想列举一个异步时钟域中出现的很典型的问

  3. 所属分类：其它

    • 发布日期：2019-09-05
    • 文件大小：203776
    • 提供者：weixin_38743506

  1. 跨时钟域信号同步解决方案.pdf

  2. 该文件主要内容是包括了在FPGA或者数字IC设计中产生的跨时钟域的各种问题，并有详细的解决方案，可以应对面试过程中所包含的知识点。

  3. 所属分类：硬件开发

    • 发布日期：2020-06-25
    • 文件大小：1048576
    • 提供者：XXQ121

  1. 源同步信号跨时钟域采集的两种方法

  2. 对于数据采集接收的一方而言，所谓源同步信号，即传输待接收的数据和时钟信号均由发送方产生。FPGA应用中，常常需要产生一些源同步接口信号传输给外设芯片，这对FPGA内部产生时钟或数据的逻辑和时序都有较严格的要求。而内部的逻辑和时序。当然，无论何种情况，目的只有一个，保证信号稳定可靠的被传送或接收。

  3. 所属分类：其它

    • 发布日期：2020-08-04
    • 文件大小：71680
    • 提供者：weixin_38629274

  1. 基于FPGA的跨时钟域信号处理——同步设计的重要

  2. 上次提出了一个处于异步时钟域的MCU与FPGA直接通信的实现方式，其实在这之前，特权同学想列举一个异步时钟域中出现的很典型的问题。也就是要用一个反例来说明没有足够重视异步通信会给整个设计带来什么样的危害。

  3. 所属分类：其它

    • 发布日期：2020-08-12
    • 文件大小：153600
    • 提供者：weixin_38742927

  1. 基于FPGA的跨时钟域信号处理同步设计的重要

  2. 本文我们主要来讨论一下基于FPGA的跨时钟域信号处理同步设计的重要，希望能对你的学习有所帮助。

  3. 所属分类：其它

    • 发布日期：2020-08-12
    • 文件大小：178176
    • 提供者：weixin_38540782

  1. 基于FPGA的TMR电路跨时钟域同步技术

  2. 三模冗余(TMR)电路中的跨时钟域信号可能会受到来自信号偏差和空间单粒子效应(SEE)的组合影响。通过建立数学模型，对这两个问题进行分析和量化。最后针对长脉宽和短脉宽源信号的不同情况，提出了相应的解决方案。

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：342016
    • 提供者：weixin_38700779

  1. 多时钟系统下跨时钟域同步电路的设计

  2. 针对当前SOC内部时钟越来越复杂、接口越来越多以及亚稳态、漏信号等常见的各种问题，分析了以往的优化方法的优缺点，然后从电路的角度出发，提出了一种新的SOC跨时钟域同步电路设计的方法。这种方法电路简单，可靠性高，通过仿真实验和实测实验验证，能够在多时钟系统中适应最小输入脉宽、不漏信号、避免误触发和多触发，且很好地解决了亚稳态等问题。

  3. 所属分类：其它

    • 发布日期：2020-10-16
    • 文件大小：474112
    • 提供者：weixin_38577922

  1. 基于FPGA的跨时钟域信号处理——同步设计的重要

  2. 上次提出了一个处于异步时钟域的MCU与FPGA直接通信的实现方式，其实在这之前，特权同学想列举一个异步时钟域中出现的很典型的问题。也就是要用一个反例来说明没有足够重视异步通信会给整个设计带来什么样的危害。

  3. 所属分类：其它

    • 发布日期：2020-10-19
    • 文件大小：191488
    • 提供者：weixin_38500948

  1. 多时钟域下同步器的设计与分析

  2. 摘　　要：本文提出了多时钟域逻辑设计中的一般问题，介绍了异步电路设计中同步化处理的重要作用，分析了触发器失效的原因和几种可行的解决亚稳态失效的方法。 　　引言 　　在数字电路设计中，大部分设计都是同步时序设计，所有的触发器都是在同一个时钟节拍下进行翻转。这样就简化了整个设计，后端综合、布局布线的时序约束也不用非常严格。但是在设计与外部设备的接口部分时，大部分外部输入的信号与本地时钟是异步的。在SoC设计中，可能同时存在几个时钟域，信号的输出驱动和输入采样在不同的时钟节拍下进行，可能会出现一些

  3. 所属分类：其它

    • 发布日期：2020-11-10
    • 文件大小：134144
    • 提供者：weixin_38582909

  1. 跨时钟域信号的几种同步方法研究

  2. 为使跨时钟域信号能够被目标时钟正确采集，提出并总结了几种同步方法，详尽论述了这些方法所涉及的存储器计算和synthesis设置。跨时钟域信号的同步方法应根据源时钟与目标时钟的相位关系、该信号的时间宽度和多个跨时钟域信号之间的时序关系来选择。如果两时钟有确定的相位关系，可由目标时钟直接采集跨时钟域信号，且在synthesis中应设此两时钟为同步关系；否则，需要借助FIFO（First in， First out），在synthesis时，此两时钟必须设为false path关系。跨时钟域信号的宽度

  3. 所属分类：其它

    • 发布日期：2021-01-31
    • 文件大小：1048576
    • 提供者：weixin_38723559
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