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  1. 基于FPGA的数字频率计设计

  2. 本文要设计一个8位十进制数字频率计，需要由四种器件来组成，即：测频控制信号发生器(FTCTRL)、有时钟使能的十进制计数器(CNT10)、32位锁存器(REG32B)、除法器模块(division). 因为是8位十进制数字频率计，所以计数器CNT10需用8个，7段显示LED7也需用8个. 频率测量的基本原理是计算每秒钟内待测信号的脉冲个数。 为此，测频控制信号发生器FTCTRL应设置一个控制信号时钟CLKK，一个计数使能信号输出端CNT_EN、一个与CNT_EN输出信号反向的锁存输出信号Loa

  3. 所属分类：硬件开发

    • 发布日期：2009-06-09
    • 文件大小：129024
    • 提供者：maochu

  1. 计算机组成原理本科复习题1

  2. 本科生期末试卷六 一． 选择题（每小题1分，共10分） 1． 完整的计算机应包括___d___。 A 运算器、存储器、控制器 ； B 外部设备和主机 ； C 主机和实用程序 ； D 配套的硬件设备和软件系统 ； 2． 用64位字长（其中1位符号位）表示定点小数时，所能表示的数值范围是___b___。 A [ 0，264 – 1 ] B [ 0，263 – 1 ] C [ 0，262 – 1 ] D [ 0，263 ] 3． 四片74181ALU和1片74812CLA器件相配合，具有如下进位传递

  3. 所属分类：C

    • 发布日期：2010-06-17
    • 文件大小：1048576
    • 提供者：zlzhoulei

  1. 基于FPGA的32位除法器设计

  2. 摘 要：介绍了一种使 用可编程逻辑 器件 FPGA和 VHDL语 言实现 32位除法器的设计方法。该 除法器不仅可以实现有符号数运算，也可以实现无符号数的运算。除法器采用节省 FPGA逻辑资源的 时序方式设计，主要由移位 、比较和减法三种操作构成。由于优化 了程序结构，因此程序浅显易懂 ，算 法简单 ，不需要分层次分模块进行。并使 用 Altera公 司的 QuartusⅡ软件对该除法器进行编译、仿真， 得 到 了完全 正确 的 结果

  3. 所属分类：硬件开发

    • 发布日期：2012-12-06
    • 文件大小：207872
    • 提供者：nfftk4125

  1. （熟读专家系列）《ModelSim电子系统分析及仿真》

  2. 《ModelSim电子系统分析及仿真》主要内容简介：ModelSim是优秀的HDL仿真软件之一，它能提供友好的仿真环境，是业界唯一的单内核支持VHDL和Verilog混合仿真的仿真器。它采用直接优化的编译技术、Tcl/Tk技术和单一内核仿真技术，编译仿真速度快，编译的代码与平台无关，便于保护IP核，个性化的图形界面和用户接口，为用户加快调错提供强有力的手段，是FPGA/ASIC设计的首选仿真软件。《ModelSim电子系统分析及仿真》以ModelSim 6.1f版软件为例，由浅入深、循序渐进地

  3. 所属分类：硬件开发

    • 发布日期：2013-08-15
    • 文件大小：48234496
    • 提供者：u011708448

  1. 32位限位浮点数乘法器

  2. 在学习《自己设计制作CPU与单片机》这本书时，根据书中的线索在quartus II 13.1下斗出来的32位限位浮点数的乘法器（一样的步骤设计其除法器）。

  3. 所属分类：嵌入式

    • 发布日期：2015-07-12
    • 文件大小：13631488
    • 提供者：misskissc

  1. R5F100LEA中文资料

  2. RL78/G13用户手册 硬件篇  最短指令执行时间可在高速(0.03125 s: @ 32 MHz 高速片上振荡器时钟运行时)至超低速(30.5 s: @ 32.768 kHz 副 系统时钟运行时)之间更改  通用寄存器: 8 位32 个寄存器(8 位8 个寄存器4 组)  ROM: 16 至512 KB，RAM: 2 至32 KB，数据闪存: /4/8 KB  内置高速片上振荡器时钟  可从32 MHz (TYP.) , 24 MHz (TYP.), 16 MHz (

  3. 所属分类：硬件开发

    • 发布日期：2015-08-07
    • 文件大小：26214400
    • 提供者：u014556960

  1. 除法器：32位处以16位

  2. 除法器：32处以16位，fpga可综合，verilog代码

  3. 所属分类：电信

    • 发布日期：2016-05-15
    • 文件大小：22528
    • 提供者：fengzheng253

  1. 4位定点除法器EDA verilog HDL 源代码

  2. 4位定点除法器，32位的写法也一样，希望verilog HDL 高手指点，初学者参考吧

  3. 所属分类：专业指导

    • 发布日期：2009-01-20
    • 文件大小：207872
    • 提供者：u012596983

  1. 32位verilog 除法器

  2. Verilog hdl 语言编写的32位除法器，使用状态机，实现有符号和无符号

  3. 所属分类：其它

    • 发布日期：2018-01-18
    • 文件大小：3072
    • 提供者：zyfzjuer

  1. 东软载波 ES7P003 Datasheet 中文手册

  2. 东软载波 ES7P003单片机的中文数据手册。ES7P003管脚兼容STM8S003、新唐N76E003，主要性能特点： 工作电压范围：2.3V ~ 5.5V  工作温度范围：-40 ~ 85℃  设计工艺及封装  低功耗、高速FLASH CMOS 工艺  20 个管脚，采用TSSOP封装  内核  ES7P RISC CPU内核  79 条精简指令  系统时钟工作频率最高为16MHz  指令周期为2个系统时钟周期  复位向量位于0000H，默认中断向量位于0004H 

  3. 所属分类：嵌入式

    • 发布日期：2019-03-21
    • 文件大小：2097152
    • 提供者：wandtor

  1. Vivado下verilog除法器（较少资源占用）

  2. 减少资源占用的一种除法器，可完成32位整数除法运算，并得出余数。

  3. 所属分类：硬件开发

    • 发布日期：2019-04-16
    • 文件大小：410624
    • 提供者：judas1801

  1. FU6811-18-31芯片资料全.pdf

  2. FU68XX芯片数据手册 双核：电机专用引擎 ME 和 8051 内核。ME 硬件自动完成电机 FOC/BLDC 运算控制; 8051内核用于参数配置和日常事务处理  指令周期大多为 1T 或 2T  16Kx8bit Flash ROM、带 CRC 校验功能、支持程序自烧录和代码保护功能  256x8bit IRAM，4Kx8bit XRAM  ME：集成低通滤波器(LPF)、比例积分器(PI)、SVPWM/SPWM、FOC 模块  单周期 16*16 位乘法器，

  3. 所属分类：C

    • 发布日期：2019-10-04
    • 文件大小：26214400
    • 提供者：weixin_45563085

  1. DS_NUC122_Series_SC_V2.01.pdf

  2. DS_NUC122_Series_SC_V2.01nuvT。n NUC122 串行外围设备接口 概述 特征 定时器控制器 概述 特征 接凵控制器 概述 特征 看门狗定时器 概述 特征 设备控制器 概述 特征 电气特性 绝对最大额定值 直流电气特性 交流特性 外部 高速晶体交流特性 外部 高速晶体 外部 低速晶体 内部 高速振荡器 内部 低高速振荡器 模拟特性 和电源管理规格 低压复位规格 欠压检测规格 上电复位规格 规格 电气特性 封装信息 历史版本信息 图 图 框图 图功能框图 图 电源分配图

  3. 所属分类：其它

    • 发布日期：2019-09-14
    • 文件大小：1048576
    • 提供者：weixin_38743481

  1. 180°电机控制在家电上应用.pdf

  2. 180°电机控制在家电上应用pdf,近年来180°电机控制因其节能、静音及低颤动而得到广泛的关注和应用，尤其在家电领域里，如油烟机、冰箱、空调及洗衣机等。瑞萨电子目前推出了一系列变频控制专用的8位MCU，本文主要介绍瑞萨电子8位MCU――uPD78F0712的主要特点及基于该MCU的家电风机解决方案。坐标变换。 该系列8位MC∪有6个外韶中断,能够快速响应外韶中断,如传感器的反馈信息等,极大的降低了 电机控制方案的成本,它有32个8位(或16个16位)Bank结构的通用寄存器,使得运行效率更高。

  3. 所属分类：其它

    • 发布日期：2019-09-13
    • 文件大小：224256
    • 提供者：weixin_38743737

  1. TRM_NUC029_Series_SC_Rev1.02.pdf

  2. NuMicro ® 家族 NUC029 系列 技术参考手册 NuMicro ® NUC029系列是以ARM ® Cortex ® -M0为内核的32位微控制器，适用于工业控制以及需 要多种通信接口、高集成度、高性能、低成本的应用。Cortex ® -M0是最新的ARM ® 嵌入式处理器， 拥有32位机的性能以及与传统8位机相当的价格。NuMicro ® NUC029系列包括3个型号： NUC029LAN, NUC029TAN 及 NUC029FAEnuvoTon NUC029 概述 197 系统

  3. 所属分类：嵌入式

    • 发布日期：2019-09-03
    • 文件大小：7340032
    • 提供者：qq_35351713

  1. 32位除法器设计Verilog代码.zip

  2. 32位除法器设计Verilog代码.zip

  3. 所属分类：硬件开发

    • 发布日期：2019-08-24
    • 文件大小：724
    • 提供者：drjiachen

  1. 计算机组成原理复习资料.pdf

  2. 计算机组成原理的复习资料by中大，这个里边总结的东西非常独到Computer Organization and design the hardware/Software Interface Fifth editic 性能度量公式:CPU性能公式:cPU时间=指令数*cP时钟周期时间 或 cPU时间=指令数CP时钟频率 指令数:执行某程序所需的指令数量;CPl:执行某个程序段时每条指令所需的时钟周 期数;时钟周期时间:时钟频率的倒数 功耗墙:功耗( Power),功率的损耗,在单位吋间中所消耗的能

  3. 所属分类：讲义

    • 发布日期：2019-07-04
    • 文件大小：1048576
    • 提供者：weixin_38889708

  1. 2015-频谱分析仪设计报告汇编.pdf

  2. 2015年的大学生电子设计大赛题目-频谱分析仪设计报告-汇编，都是获得国赛一二等奖的作品E题80MHz~100MHz频谱分析仪 、任务 设计制作一个简易频谱仪。频谱仪的本振源用锁相环制作。频谱仪的基本结构图如图 E-1所示。 信号源输入一混频 滤波 显示 本振源 频率显示 图E-1频谱仪的基本结构图 要求 1.基本要求 制作一个基于锁相环的本振源: (1)频率范围90~110MHz; (2)频率步进100kHz; (3)输出电压幅度10~100mV,可调; (4)在整个频率范围内可自动扫描;扫描

  3. 所属分类：硬件开发

    • 发布日期：2019-07-01
    • 文件大小：12582912
    • 提供者：gxiangming

  1. 基于PIC24F16KA102 XLP设计的16位MCU开发技术

  2. PIC24F16KA102是极低16位MCU，采用改进型哈佛架构，32MHz时高达16MIPS，带4x PLL选择和多个除法选择的8MHz振荡器，17位x17位单周期硬件乘法器，32位x16位硬件除法器，16位x16位工作寄存器阵列，C编译器，运行模式的功耗低到8uA，深度睡眠模式的功耗为20nA，工作电压1.8V到 3.6V，住要用途包括RF传感器，数据采集器，温度传感器，电子门锁，测量传感器，遥控，安全传感器，智能卡和能量收获等。

  3. 所属分类：其它

    • 发布日期：2020-10-24
    • 文件大小：327680
    • 提供者：weixin_38616139

  1. FPGA 64位除法器(Verilog)

  2. 使用verilog语言，通过移位减方式实现64位除以32位数据的除法器，所需资源少，运算速度约64个时钟周期，可方便的自动修改运算位数

  3. 所属分类：嵌入式

    • 发布日期：2020-12-02
    • 文件大小：1024
    • 提供者：XingouChen
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