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数字逻辑课程设计之数字式秒表
数字是秒表 设计要求: 1.设计并制作符合要求的电子秒表, 2.由6位显示,两位显示‘分’,两位显示秒,两位显示百分秒, 3.最大至99分59.99秒 4.具有清零,启动,暂停,继续功能 5,最多2个控制按键 是我们最近的课程设计的小题目,我刚做完,采用74160十进制加法计数器设计完成,通过仿真波形测试,无60秒的暂态,误差小于0.0003秒。内附帮助文件
所属分类:
嵌入式
发布日期:2009-06-26
文件大小:38912
提供者:
yjf309
数字逻辑课程设计之数字式秒表
数字是秒表 设计要求: 1.设计并制作符合要求的电子秒表, 2.由6位显示,两位显示‘分’,两位显示秒,两位显示百分秒, 3.最大至99分59.99秒 4.具有清零,启动,暂停,继续功能 5,最多2个控制按键 是我们最近的课程设计的小题目,我刚做完,采用74160十进制加法计数器设计完成,通过仿真波形测试,无60秒的暂态,误差小于0.0003秒。内附帮助文件,原理图与波形解压后请放在非中文目录下
所属分类:
嵌入式
发布日期:2009-06-26
文件大小:5120
提供者:
yjf309
4键控制秒表 可启动 停止
3位数码显示秒表 4个按键分别实现启动 停止 清0 松手运行功能 已通过开发板调试 能稳定运行
所属分类:
其它
发布日期:2009-12-05
文件大小:702
提供者:
w19864173
数字式秒表课程设计方法,案例。
1、秒表最大计时值为99分59.99秒; 2、6位数码管显示,分辨率为0.01秒; 3、具有清零、启动计时、暂停及继续计数等控制功能; 4、控制操作键不超过二个。
所属分类:
专业指导
发布日期:2010-03-07
文件大小:646144
提供者:
weifengdage
单片机编程实例教程(非常详细)
本教程非常不错,教程目录如下 第1章 PIC16F877的外围功能模块 第2章 模拟量输入与输出 第3章 秒表 第4章 通用同步/异步通信应用 第5章 PIC16F87X在CAN中的应用 第6章 利用CCP模块设计频率计 第7章 交流电压测量 第8章 与PLC接口的4位LED数字显示表 第9章 章片机控制的电动自行车驱动系统 第10章 液晶显示模块编程
所属分类:
硬件开发
发布日期:2010-04-10
文件大小:175104
提供者:
joxxyai
电气工程及其自动化电子设计—数字倒计时秒表
设计内容与设计要求 一. 设计内容 设计一个适于各类场合的通用倒计时系统,功能要求如下: 1) 计时器的计时间隔为1S,其递减计数器的模在59分59秒至00分01秒范围内可预置。 2)设置4个预置按钮,分别用于分个位、分十位和秒个位、秒十位的预置,预置时通过按钮对相应的时间位进行递增计数来完成预置。 3) 倒计时器通过外部功能键使其具有直接复位、启动、暂停/继续等功能; 4) 具有显示功能,用LED数码管实现; 5) 计时数器递减到零时,LED数码显示器的“00∶00”字样发生闪烁(或停止),
所属分类:
专业指导
发布日期:2010-05-05
文件大小:119808
提供者:
sertina
基于FPGA的数字秒表设计
本科生毕业论文(设计)开题报告书 题 目: 基于FPGA的数字秒表设计 学生姓名: *********** 学 号: ********** 专业班级: 自动化******班 指导老师: ************ 2010年 3 月 20 日 论文(设计)题目 ISP技术及其应用研究 课题目的、意义及相关研究动态: 课题设计的主要目的:运用所学的数字电子技术的基本知识和数字电子电路的设计方法,将数字电子技术的基础知识与EDA技术有机地联系起来,EDA电子仿真软件的仿真功能强大,具有完备的文件库,
所属分类:
嵌入式
发布日期:2010-06-16
文件大小:747520
提供者:
sanpao2010
体育比赛用的数字秒表
一、 实验任务及要求 设计用于体育比赛用的数字秒表,要求: 1、 及时精度大雨1/1000秒,计数器能显示1/1000秒时间,提供给计时器内部定时的始终频率为12MHz;计数器的最长计时时间为1小时,为此需要一个7位的显示器,显示的最长时间为59分59.999秒。 2、设计有复位和起/停开关。 (1)、复位开关用来使计时器清零,并做好计时准备。 (2)、起/停开关的使用方法与传统的机械式计数器相同,即按一下起/停开关,启动计时器开始计时,再按一下起/停开关计时终止。 (3)、复位开关可以在任何
所属分类:
网络攻防
发布日期:2010-07-02
文件大小:156672
提供者:
antonio321
Android秒表计时器安装文件
简介:计时器小程序——秒表计时器,程序界面简洁,只有一个时间显示区域和两个图片按钮,一个按钮是开始/暂停,另一个按钮是停止。 1.功能: (1)根据用户设置.按0.1秒或1秒为最小单位计时,满60秒进为分钟,最大单位是分钟。 默认分钟为两位,超过两位后自动变为三位分钟。 (2).显示格式为 1.最小计时单位为0.1秒时,显示为:分钟:秒:0.1秒。例如:02:07:5 2.最小计时单位为1秒时,显示为:分钟:秒。例如:02:07 2.操作步骤 (1).按开始按钮,开始计时,此时开始按钮变为暂停
所属分类:
Android
发布日期:2010-08-08
文件大小:33792
提供者:
ameyume
简易秒表时钟的设计含C语言及proteus仿真
含C程序 proteus仿真 本设计任务 (1)以24h(小时)计时方式,显示格式为: 13.-25-15 (2)用八位LED数码管显示时、分、秒 (3)使用按键开关可实现时分调整 (4)使用按键开关可实现时分秒表 /时钟功能转换通过按键进行时钟/秒表功 能的转换,时钟计时每1s进行加1操作,秒表计时每10ms进行加1操 作。 按键实现计时启动、暂停及清零功能。 省电模式
所属分类:
C
发布日期:2010-12-30
文件大小:596992
提供者:
qin13854034805
基于单片机多功能秒表的设计
多功能秒表系统采用AT89C51单片机为中心器件,利用其定时器/计数器定时和记数的原理,结合显示电路、电源电路、LED数码管以及键盘电路来设计计时器。将软、硬件有机地结合起来,使得系统能够实现两位LED显示,显示时间为00~99秒,每秒自动加1,能正确地进行加1,快加,可以同时记录4个相对独立的时间
所属分类:
硬件开发
发布日期:2011-01-02
文件大小:267264
提供者:
a525708240
数字电子技术是课程设计 数字秒表设计
1. 设计并制作符合要求的电子秒表。 2. 秒表由6位7段LED显示器显示,其中2位显示“min”,4位显示“s”,其中显示分辨率位“0.01S”。 3. 计数最大值到99min59.99s,计数误差不超过0.01s, 4. 具有清零、启动计数、暂停计时及继续计时等控制功能。
所属分类:
专业指导
发布日期:2011-03-20
文件大小:1048576
提供者:
zwc_mail
单片机实验箱4位数码管秒表实验
单片机实验箱4位数码管秒表实验,内有流程图,c语言代码跟对应的asm汇编代码
所属分类:
嵌入式
发布日期:2013-02-21
文件大小:145408
提供者:
cszzh332
用verilog语言编写的4位秒表实现.rar
(1)4位秒表设计实现要求及设计思路.doc //给出了设计的指标和设计思路,给需要修改程序的朋友提供了一定的参考价值; (2)miaobiao 文件夹//包含了所有程序和版图;相信能给学习verilog的朋友提供真正的帮助。
所属分类:
专业指导
发布日期:2008-10-13
文件大小:278528
提供者:
elia2008
51单片机4位数码管秒表设计
是基于51单片机的秒表程序,4位共阳数码管
所属分类:
C
发布日期:2015-12-05
文件大小:27648
提供者:
ang_ie
51单片机数码管秒表0.c
51单片机数码管秒表0.c
所属分类:
C/C++
发布日期:2020-04-01
文件大小:2048
提供者:
qq_44859851
502-4位飞秒三键.rar
基于单片机的秒表设计,适合于电气专业方面的课程设计参考,全套资料,包括:原理图、讲解、仿真、任务书、代码等等。
所属分类:
C
发布日期:2020-10-07
文件大小:42991616
提供者:
tiankaiwentiankaiwen
4位共阴极数码管秒表.zip
51单片机、 秒表、秒表、数码管显示
所属分类:
C
发布日期:2020-10-29
文件大小:244736
提供者:
LINIXG
EDA/PLD中的基于FPGA的数字秒表的设计
应用VHDL语言设计数字系统,很多设计工作可以在计算机上完成,从而缩短了系统的开发时间,提高了工作效率。本文介绍一种以FPGA为核心,以VHDL为开发工具的数字秒表,并给出源程序和仿真结果。 1 系统设计方案 1.1 系统总体框图 数字秒表主要有分频器、计数模块、功能控制模块、势能控制模块和显示输出模块组成。系统框图如图1所示。 本次的设计仿真选用以EPlC6Q240芯片为核心的FPGA开发板,该开发板提供了较完善的外围周边电路和信号接口,并提供了一块4位7段数码
所属分类:
其它
发布日期:2020-11-09
文件大小:342016
提供者:
weixin_38741195
基于FPGA的数字秒表的设计
应用VHDL语言设计数字系统,很多设计工作可以在计算机上完成,从而缩短了系统的开发时间,提高了工作效率。本文介绍一种以FPGA为,以VHDL为开发工具的数字秒表,并给出源程序和仿真结果。 1 系统设计方案 1.1 系统总体框图 数字秒表主要有分频器、计数模块、功能控制模块、势能控制模块和显示输出模块组成。系统框图如图1所示。 本次的设计仿真选用以EPlC6Q240芯片为的FPGA开发板,该开发板提供了较完善的外围周边电路和信号接口,并提供了一块4位7段数码管的扩展
所属分类:
其它
发布日期:2021-01-19
文件大小:501760
提供者:
weixin_38506138
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