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搜索资源 - 6位数字钟
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用ARM 运行的数字钟源程序
/********************************************************************* ** 功能 :运行RTC进行计时,将时间值通过串口向上位机发送。同时其值可变 ** 上位机使用EasyARM软件,在仿真的万年历显示器显示结果。 ** 说明 :通讯波特率115200,8位数据位,1位停止位,无校验。 ********************************************************************/
所属分类:
硬件开发
发布日期:2009-06-24
文件大小:11264
提供者:
li870115
单片机制作的6位数字钟
单片机制作单片机制作的6位数字钟的6位数字单片机制作的6位数字钟钟单片机制作的6位数字钟
所属分类:
硬件开发
发布日期:2009-11-30
文件大小:8192
提供者:
czy709191004
数字钟的设计-数字电路
数字钟主要分为数码显示器、60进制和12进制计数器、频率振荡器和校时这几个部分。数字钟要完成显示需要6个数码管,八段的数码管需要译码器械才能显示,然后要实现时、分、秒的计时需要60进制计数器和12进制计数器,在在仿真软件中发生信号可以用函数发生器仿真,频率可以随意调整。60进制可能由10进制和6进制的计数器串联而成,而小时的12进制可以采用74LS191的十进制计数器和D触发器来产生计数和进位。频率振荡器可以由晶体振荡器分频来提供,也可以由555定时来产生脉冲并分频为1HZ。
所属分类:
嵌入式
发布日期:2009-12-26
文件大小:212992
提供者:
k0307411
单片机简易(数字钟论文)
一 摘要 单片计算机即单片微型计算机。(Single-Chip Microcomputer ),是 集CPU ,RAM ,ROM , 定时,计数和多种接口于一体的微控制器。他体积小,成本低,功能强,广泛应用于智能产 品和工业自动化上。而51 单片机是各单片机中最为典型和最有代表性的一种。这次毕业设 计通过对它的学习,应用,从而达到学习、设计、开发软、硬的能力。 二 说明 系统由AT89C51、LED 数码管、按键、发光二极管等部分构成,能实现时间的调整、定 时时间的设定,输出等功能。系统的功能
所属分类:
硬件开发
发布日期:2009-12-31
文件大小:206848
提供者:
oycxcom
EDA课程设计多功能数字钟
1、能进行正常的时、分、秒计时功能,分别由6个数码管显示24小时、60分钟、60秒钟的计数器显示。 2、能利用实验系统上的按键实现“校时”“校分”功能: ⑴按下“SA”键时,计时器迅速递增,并按24小时循环,计满23小时后回“00”; ⑵按下“SB”键时,计分器迅速递增,并按59分钟循环,计满59分钟后回“00”,但不向“时”进位; ⑶按下“SC”键时,秒清零; ⑷要求按下“SA”、“SB”或“SC”时均不产生数字跳变(SA”、“SB”、“SC”按键是有抖动的,必须对其消除抖动处理)。 3、能
所属分类:
其它
发布日期:2010-01-08
文件大小:433152
提供者:
yinheng1314
AD7799中文资料
特性: RMS噪声(有效值噪声): 在4.13HZ转换率下紧为27nV(AD7799). 在16.7HZ转换率下为65Nv. ·低 功 耗 ,典型为300uA ·内 置 1一 128增益的低噪声可编程仪表放大器; ·内 置 时 钟振荡器,省去了外接晶振; ·低 非 线 性度:0.0015%; ·内 设 自 校准电路; ·带 有 SPI数据接口,可以方便地与DPS 或者MCU连接; ·50 H z和 06Hz同步陷波,消除05Hz和06Hz电源干扰; ·可 配 置 3个差分输人通道; ·21 位
所属分类:
C
发布日期:2010-04-13
文件大小:402432
提供者:
guofeihuiyuan
单片机数字钟-温度计程序
这是我自己写的多功能数字钟的程序,实现的功能是:1、开机后可以通过接在P1口的4*4键盘设置时间;2、能够将接在P2^4上的ds18b20中的温度读回单片机;3、通过接在P0口上的LCD显示时间与温度;(说明:时间是用定时器写的,没有用实时时钟芯片;程序成功实现全部功能,不过有点乱~~) 硬件上很简单的,电源与地,晶振;P1口接4*4键盘;P0口接LCD八位数据线与上啦电阻;lcd中的rs、rw、en依次接P2^5、P2^6、P2^7
所属分类:
硬件开发
发布日期:2010-04-26
文件大小:37888
提供者:
fuxilu
基于VHDL的数字钟设计
基于VHDL的数字钟课程设计报告 目录 摘 要 3 引 言 3 1 数字钟的设计框图 3 2 功能说明 4 3 模块设计部分 4 3.1位选模块 4 3.2控制模块 5 3.4 8 3.5 记小时模块 10 3.6 闹钟,报时模块 11 3.7 动态扫描模块 12 3.8 译码 13 3.8.1 译码模块 13 3.8.2 选通译码 14 4系统仿真 15 4.1 数字钟原理图 15 4.2 数字钟仿真图 16 4.2.2 整点报时 16 4.2.3 暂停状态 17 4.2.4 调闹钟 17
所属分类:
嵌入式
发布日期:2011-01-01
文件大小:214016
提供者:
chenwei_7
数字系统设 计实验指导书.doc
第一章 MAX+PLUS II开发软件简介 ................................3 1.1 MAX+PLUS 软件的功能................................................ 3 1.1.1 MAX+PLUS II的组成 ................................................. 3 1.1.2 MAX+PLUS II的VHDL设计资源 ........................
所属分类:
嵌入式
发布日期:2011-02-24
文件大小:1048576
提供者:
bhanzdan
单片机做的6位时分秒数字钟
用at89c51做的一个6位的数字钟,可以显示小时 分钟 秒,并且实现了可以调试的功能 有c语言源程序 以及prote仿真图
所属分类:
C
发布日期:2011-03-18
文件大小:53248
提供者:
lzjforever
数字逻辑电路设计
数字电路课程设计的报告,包括部分代码和截图 设计目的 学会应用数字方法设计电路 进一步提高maxplus2软件的应用能力 培养学生实践的综合实力 二、设计方案 用maxplus2软件设计多功能数字钟,采用层次化的设计方法,底层使用VHDL语言设计各模块的功能,然后使用画图方法设计顶层。 设计中包括计时,校时,整点闹铃,闹钟4大模块 计时模块:用VHDL语言设计24进制计时、60进制计分、60进制计秒模块,秒的进位为分的计数脉冲,分的进位为时的计数脉冲,按键MM选择六选一多路选择器动态输出,频率
所属分类:
C/C++
发布日期:2011-11-26
文件大小:436224
提供者:
j985674981
基于单片机的数字钟设计
本设计采用的是基于AT89C51型单片机里的定时器T0来实现24小时制的时间的计时。在12MHz晶振频率的条件下,通过程序对单片机的定时器T0赋值一个初值来实现时间为一秒间隔的计时。时间的刷新和显示则是通过定时中断和通过一个6位的7段共阴极LED来显示实现。段码由P0输出,在P0口和LED接口之间有一个74LS245芯片,主要用来保真证LED能正常显示,P2口则作为片选信号输出端和6位LED的片选端相连。本设计一共使用了3个独立键盘来实现初始时间的设定。此外,单片机还有一个时钟电路和一个上电复
所属分类:
硬件开发
发布日期:2011-12-11
文件大小:2097152
提供者:
luomeigang
实用单片机电子钟的制作6位数字钟
本设计基于 单片机的时钟制作,有很好的效用
所属分类:
硬件开发
发布日期:2012-06-10
文件大小:2048
提供者:
yedejintou
数字时钟设计,用的是vhdl语言
根据以上对于多功能数字钟的功能的描述,可以将整个的电路设计分为以下几个模块: 分频模块:由于实验电路板上所能提供的只有1Khz和6Mhz的信号,而本设计过 程的即时以及跑表模块需要1hz、100hz和4hz的时钟信号。 控制模块:为达到多动能数字钟在计时、校时、显示日历、跑表等不同的模块之间 切换,需要控制模块产生时序要不相冲突的控制信号,保证各个模块的功能有序的执行。 计时模块:在输入的1hz时钟信号,产生显示的AM、PM、时、分、秒信号,由 于要涉及到后面的校时模块,这里采用带有置数的计时
所属分类:
其它
发布日期:2013-09-25
文件大小:207872
提供者:
zhou8023chao
verilog多功能数字钟
完整齐全目 录 1、绪论 1 2、VERILOG HDL的基础知识 2.1 VERILOG HDL 概述 2 2.1.1 VERILOG HDL的发展历史 2 2.1.2 VERILOG HDL的主要功能 2 3、多功能数字钟的设计 8 3.1设计任务 8 3.2 多功能数字钟功能概述 10 3.3多功能数字钟系统框图 10 3.4详细功能及状态描述 3 3.5 参考模块设计 10 3.5.1 主控制模块maincontrol 10 3.3.2. 时间及其设置模块timepiece_main
所属分类:
嵌入式
发布日期:2014-07-10
文件大小:606208
提供者:
clever_man
基于verilog的fpga数字钟
l、能进行正常的时、分、秒计时功能,分别由6个数码显示24小时、60分钟的计数器显示。 2、能利用实验系统上的按钮实现“校时”、“校分”功能; (1)按下“SA”键时,计时器迅速递增,并按24小时循环; (2)按下“SB”键时,计时器迅速递增,并按59分钟循环,并向“时”进位; (3)按下“SC”键时,秒清零;抖动的,必须对其消抖处理。 3、能利用扬声器做整点报时: (1)当计时到达59’50”时开始报时,频率可为500Hz; 计满23小时后回零;计满59分钟后回零。 (2)到达59’59”时
所属分类:
专业指导
发布日期:2017-06-09
文件大小:3145728
提供者:
qq_35364022
基于EDA数字钟设计报告
1题目分析 1.1 设计要求(数字钟的功能) (1)具有秒、分、时技术显示功能,且以24小时循环计时; (2)具有清零功,且能调时、调分; (3)具有整点报警功能,并且在报警过程中能中断报警。 根据以上功能要求,可设计以下的功能方块图: 1.2功能要求分析 根据以上数字钟的功能要求,需要完成以下几个部分: (1)时钟模块:由试验箱内部时钟提供,对计数器提供计数时钟信号; (2)秒钟模块:对秒进行60进制循环计数,并向分钟产生进位,同时具有调分功能; (3)分钟模块:对分进行60进制循环计数,并
所属分类:
其它
发布日期:2008-12-23
文件大小:2097152
提供者:
dongxiaoyao
基于FPGA的数字钟
基于FPGA的电子时钟设计,具有调时、整点报时等功能。用简单的计数和进位的功能实现、用6位数码管显示。
所属分类:
硬件开发
发布日期:2019-04-14
文件大小:293888
提供者:
qq_42428442
嵌入式系统/ARM技术中的基于FPGA的多功能数字钟设计
现场可编程门阵列(Field Programmable Gate Arrays,FPGA)是一种可编程使用的信号处理器件。通过改变配置信息,用户可对其功能进行定义,以满足设计需求。通过开发,FPGA能够实现任何数字器件的功能。与传统数字电路相比,FPGA具有可编程、高集成度、高可靠性和高速等优点。 1 数字钟总体设计 本文以FPGA平台为基础,在QuartusⅡ开发环境下设计开发多功能数字钟。数字钟实现的功能如下: 1)计时功能:进行正常的时、分、秒计时,并由6只8段数码管分别
所属分类:
其它
发布日期:2020-10-20
文件大小:168960
提供者:
weixin_38526751
基于FPGA的多功能数字钟设计
现场可编程门阵列(Field Programmable Gate Arrays,FPGA)是一种可编程使用的信号处理器件。通过改变配置信息,用户可对其功能进行定义,以满足设计需求。通过开发,FPGA能够实现任何数字器件的功能。与传统数字电路相比,FPGA具有可编程、高集成度、高可靠性和高速等优点。 1 数字钟总体设计 本文以FPGA平台为基础,在QuartusⅡ开发环境下设计开发多功能数字钟。数字钟实现的功能如下: 1)计时功能:进行正常的时、分、秒计时,并由6只8段数码管分别
所属分类:
其它
发布日期:2021-01-19
文件大小:191488
提供者:
weixin_38697274
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