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设计最优化的时钟电路
高速数字电路设计超越了简单的“1”与“0”的世界而进入模拟电路领域,避免传输线效应造成的系统故障是设计师们必须认真解决的问题。本文的目的是通过对49FCT3807与SDRAM的一驱一和一驱二时钟电路的SI(信号完整性)分析和参数的优化举例,使硬件设计工程师和PCB设计工程师了解在设计时需要考虑和注意之处。希望能够抛砖引玉。
所属分类:
专业指导
发布日期:2009-08-20
文件大小:323584
提供者:
rikky5210
Quantum SI 文档
Quantum-SITM (QSI)是一个能将信号完整性分析,串扰分析和时序分析集成在一个解决方案中,是目前唯一能处理真正的 High-Speed Design ClosureTM 的系统级的工具。 Quantum-SITM (QSI)正在迅速地日益被电器工程师和信号完整性工程师认可为高速PCB设计的标准工具。QSI 全面的分析能力使得它相比传统的信号完整性分析工具具有更大的优势: A. Quantum-SITM (QSI) 能在更短的时间内获得更精确的系统级噪声和时序裕量估计。 B. Qua
所属分类:
嵌入式
发布日期:2009-08-24
文件大小:5242880
提供者:
wxzzzh
数字电视中间件开发设计和实现
对机顶盒软件中间件各模块进行详细分析和设计,给出设计原理和设计过程,同时给出测试方案。是对相关领域的软件工程师很好的教程
所属分类:
VB
发布日期:2009-10-10
文件大小:258048
提供者:
shire382
pads9.0电子设计软件
PADS 9.0版产品的出现标志着下一代PADS流程技术的诞生。与以往的旧产品相比, PADS 9.0修复和改善了之前版本软件的不足和缺点,集成了许多全新的功能,拥有了更高的可扩展性和集成度,从而使设计者能够结合Mentor Graphics众多独特的创新技术,实现设计、分析、制造和多平台的协作。而且, 与PADS 9.0的可扩展定制流程策略相对应,Mentor Graphics提供了一系列预置的PADS套件,使之能够满足各种产品设计不同的技术要求,然而代价却十分低廉。LS和ES产品包就是因应
所属分类:
嵌入式
发布日期:2009-12-15
文件大小:29696
提供者:
cadeda2009
联想客服工程师常用技术文档
联想客服工程师常用技术文档 1.天骄机型 LEOS 1.1 - 2005系列硬盘制作 天骄SX硬盘制作 Novo Center机型硬盘制作 天骄SI(XP)机型硬盘制作 天骄SI(Vista)机型硬盘制作 预装Vista及Office的天骄SI机型制作 天骄I(Vista)机型硬盘制作 新天骄I机型硬盘制作指南 2.锋行机型 锋行K/锋行V(一键恢复4.5)硬盘制作 锋行X(XP)机型硬盘制作 锋行X(Vista)机型硬盘制作(DOS) 锋行X(Vista)机型硬盘制作(Win) 预装Vist
所属分类:
系统安全
发布日期:2010-01-28
文件大小:6291456
提供者:
ray131745769XX
【理论学习班】无线电电子电路制作(图解趣味电子制作)
如果您看到本PDF,请发邮件给 21504965@qq.com,让我知道我的付出没有白费。谢谢! 自制GPS群:19504537 (电台(短波)+GPS(GPRS选配)+陀螺仪(MEMS)) 本项目征集 志愿者: 1、工程师:硬件/软件/模具(外壳) 2、VC:疑似头脑简单型。本项目暂时看不到盈利的希望。 3、测试者。喜欢户外的同学,测试产品,写测试报告,提供产品的建议和意见。 缘起:当户外邂逅工程师 现实中,难于让人理解自己,于是开始了户外活动。 一番辗转,来到了磨房。 由于方向感差,借助G
所属分类:
硬件开发
发布日期:2010-05-03
文件大小:14680064
提供者:
wb49163
中文SI版本-用于DVB标准
详细讲述DVB-SI,中文版本。有助于流媒体方面的工程师使用。
所属分类:
VB
发布日期:2010-07-22
文件大小:3145728
提供者:
seventeen17seventeen
PSI-SI理解入门
数字电视及机顶盒软件工程师资料。主要讲述PAT,PMT,SDT几张表的内容,及相关SI业务。
所属分类:
专业指导
发布日期:2010-09-02
文件大小:292864
提供者:
wanqilin
软件分析、测试、开发和维护的利器——SI-NS图技术
产品软件“思图程序开发维护工具软件V1.0” 可以与任何主流开发平台实现无缝链接,随时将开发和维护中的程序自动变换成清晰、规范、可读性远胜于文字性程序的二维结构化程序框图(SI-NS图)。再复杂的程序一经变换成SI-NS图,程序的逻辑结构、嵌套关系、执行路径,具体细节都一目了然。 它改变了程序开发维护的传统理念,在程序设计、开发、测试、文档、维护的整个软件生存周期中,从此可以用图而不再是文字性程序分析和思维。 软件工程师终于有了自己的图形化工程语言,彼此可以用图代替文字性程序分析并进行交流和切
所属分类:
C
发布日期:2010-09-08
文件大小:157696
提供者:
sichuangen
信号完整性问题和印制电路板设计
信号完整性问题和印制电路板设计,学习高速数字电路设计以及信号分析的经典好书。初级工程师必读!此本为中文版。
所属分类:
制造
发布日期:2011-10-05
文件大小:32505856
提供者:
QQ736934266
硬件设计绝对给力
好资料,希望layout工程师多多学习,希望大家能喜欢,然后画出好的电路
所属分类:
嵌入式
发布日期:2012-08-09
文件大小:123904
提供者:
luxabss
SI经典名着之一黑宝书——高速数字设计(完整版)
这本书是专门为电路设计工程师写的 它主要描述了模拟电路原理在高速数字电路设计中的分析应用 通过列举很多的实例 作者详细分析了一直困扰高速电路路设计工程师的铃流 串扰和辐射噪音等问题。
所属分类:
硬件开发
发布日期:2015-04-26
文件大小:4194304
提供者:
qq_27715745
武功秘籍:信号完整性工程师必须掌握的9大招
武功秘籍:信号完整性工程师必须掌握的9大招
所属分类:
其它
发布日期:2016-08-03
文件大小:1048576
提供者:
q_1234_567
硬件系统工程师宝典
《EDA精品智汇馆:硬件系统工程师宝典》硬件系统设计中的常见需求,设计中需要考虑的各类概要设计及开发平台的归纳,SI的理论分析及满足SI的常用设计方法,PI的理论分析及满足PI的常用设计方法,EMC/EMI的理论分析及满足EMC/EMI的常用设计方法,DFX的理论分析及满足DFX的常用设计方法,电路设计中常用各类器件的原理说明及常用电路的原理图设计,对PCB设计中的布局、布线及PCB的板级仿真分析进行了归纳分类,对PCB设计的后续工作及PCB加工的技术要求进行了归纳总结。
所属分类:
硬件开发
发布日期:2018-01-05
文件大小:93323264
提供者:
windky82
硬件工程师面试基础知识点
该文档包含了硬件工程师面试基础知识点:晶振电路设计,LDO选型,DC-DC,通讯接口,运放应用,电磁兼容EMC,信号完整性SI-Signal Integrity
所属分类:
硬件开发
发布日期:2018-08-07
文件大小:1048576
提供者:
icifan
工程师PCB Layout总结
PCB Layout作为硬件设计中的一个重要环节,在硬件电路设计合理的情况下,它是影响性能的一个绝对重要的指标。很多的PCB Layout工程师都是按照硬件工程师或者PI SI工程师给出的约束规则来完成布局布线,这些就是俗称的“拉线工”。
所属分类:
其它
发布日期:2020-07-18
文件大小:84992
提供者:
weixin_38567873
信号完整性工程师工作职责
1、负责单板硬件及互连设计的信号完整性和电源完整性分析,定制芯片级/单板级/系统级设计约束,编写相关设计要求文档,负责单板SI设计的正确性。
所属分类:
其它
发布日期:2020-08-27
文件大小:39936
提供者:
weixin_38641366
nc-si协议的介绍
网络技术的飞速发展使得人们对于服务器的带外可管理性及可控制性提出了更高的要求。通过带外管理,工程师可以在任意地点通过网络连接到相应的服务器上,进行一系列的管理与维护,而不再需要长时间驻守在嘈杂的实验室环境中。NCSI(Network Controller Sideband Interface)就是一个由分布式管理任务组(Distributed Management Task Force, DMTF)定义的用于支持服务器带外管理的边带接口网络控制器的工业标准。
所属分类:
其它
发布日期:2020-10-28
文件大小:146
提供者:
qq_38583464
测量、识别并消除高速串行通信链路的时钟和数据抖动方案
摘要:随着新一代串行数据标准成功地从快速过渡到超高速,设计人员需要花费大量时间考虑这些高速信号的模拟设计,只是简单关注1、0数字域信号远远不能满足实际要求。为了找到潜在的问题并加以解决,从而避免现场应用出现这些问题,设计人员必须检查实际设计参数。信号完整性(SI)工程师必须降低或消除时钟抖动对系统性能的影响。本文讨论了典型速率为1Gbps或更高速率的高速串行数据链路的简单、实用的方法。 引言 高速串行链路的特性取决于SI工程师发现问题、理解问题以及解决抖动问题的能力。本文讨论中,我们
所属分类:
其它
发布日期:2020-11-06
文件大小:815104
提供者:
weixin_38567813
通信与网络中的消除高速串行链路的时钟抖动
随着新一代串行数据标准成功地从快速过渡到超高速,设计人员需要花费大量时间考虑这些高速信号的模拟设计,只是简单关注1、0数字域信号远远不能满足实际要求。为了找到潜在的问题并加以解决,从而避免现场应用出现这些问题,设计人员必须检查实际设计参数。信号完整性(SI)工程师必须降低或消除时钟抖动对系统性能的影响。本文讨论了针对典型速率为1Gbps或更高速率的高速串行数据链路的简单、实用方法。 高速串行链路的特性取决于SI工程师发现问题、理解问题以及解决抖动问题的能力。在本文讨论中,我们假设PHY(物
所属分类:
其它
发布日期:2020-11-06
文件大小:69632
提供者:
weixin_38552536
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