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eda实验指导程序 实例 等下载
eda实验指导程序实验一 1位全加器设计•••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••23 实验二 两位十进制计数器设计••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••••32 实验三 8位串入并出寄存器设计•••••••••••••••••••••••••••••••
所属分类:
专业指导
发布日期:2010-05-15
文件大小:3145728
提供者:
zzyal
第四章_原理图输入方法.ppt
4-1. 用原理图输入法设计8位全加器 (1) 实验目的:熟悉利用QuartusⅡ的原理图输入方法设计简单组合电路,掌握层次化设计的方法,并通过一个8位全加器的设计把握利用EDA软件进行原理图输入方式的电子线路设计的详细流程。
所属分类:
嵌入式
发布日期:2011-03-12
文件大小:506880
提供者:
v_the
用一位全加器设计一个四位的加法器
它是基于EDA MAX+plus 集成环境下,全加器的设计用一位全加器来设计四位全加器
所属分类:
数据库
发布日期:2011-03-22
文件大小:6144
提供者:
fzqy4700
EDA/SOPC 技术实验讲义
第一章 EDA_VHDL 实验/设计与电子设计竞赛 4 1-1、 应用QuartusII 完成基本组合电路设计 5 1-2. 应用QuartusII 完成基本时序电路的设计 6 1-3. 设计含异步清0 和同步时钟使能的加法计数器 7 1-4. 7 段数码显示译码器设计 8 1-5. 8 位数码扫描显示电路设计 9 1-6. 数控分频器的设计 10 1-7. 32 位并进/并出移位寄存器设计 10 1-8. 在QuartusII 中用原理图输入法设计8 位全加器 11 1-9. 在Quartu
所属分类:
硬件开发
发布日期:2012-04-18
文件大小:3145728
提供者:
xiaosong89
eda四位全加器的设计
eda四位全加器的设计
所属分类:
硬件开发
发布日期:2020-12-24
文件大小:13631488
提供者:
weixin_47804713