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条码打印源码(for Zebra)
注:本程序仅限于打印数据及字母的条码. head="^XA^LH20,10^BY2,2,120,0,0" 以上设置条码打印的头位置,及条码压缩比率。LH后的20,10分别表示打印的起始纵坐标和横坐标。 BY后的调整条码压缩比率(一般情况下不需要调整) barcode="^FO20,20^BCN,80,N,N,N^FD" 此段设置条码打印机的条形码打印。FO后的20,20表示条形码打印起始位为纵坐标20,横坐标20。80表示 条形码的高度。 barcode text="^FO20,90^ADN,
所属分类:
专业指导
发布日期:2005-11-12
文件大小:70656
提供者:
planks
CRC16通信校验程序,
A:循环冗余校验(CRC)算法 CRC 校验(Cyclic Redundancy Check)是一种数据传输错误检查方法,CRC 码两个字 节,包含一16 位的二进制值。它由传输设备计算后加入到数据包中。接收设备重新计算收 到消息的CRC,并与接收到的CRC 域中的值比较,如果两值不同,则有误。 具体算法如下: CRC 是先调入一值是全“1”的16 位寄存器,然后调用一过程将消息中连续的8 位字 节各当前寄存器中的值进行处理。仅每个字符中的8Bit 数据对CRC 有效,起始位和停止位 以及奇偶
所属分类:
其它
发布日期:2009-08-03
文件大小:2097152
提供者:
azlload
基于FPGA的UART電路設計與仿真.pdf
UART简介 基本的UART通信只需要两条信号线(RXD,TXD)就可以完成数据的相互通信,接收与发送 是全双工形式,其中TXD是UART发送端,RXD是UART接收端。UART的基本特点是:在信号线上 有2种状态,可分别用逻辑1(高电平)和逻辑0(低电平)来区分。在发送器空闲时,数据线应 保持在逻辑高电平状态。发送器是通过发送起始位而开始一个字符传送,起始位使数据线处 于逻辑0状态,提示接收器数据传输即将开始。数据位一般为8位一个字节的数据(也有6位、 7位的情况),低位(LSB)在前,高位
所属分类:
嵌入式
发布日期:2009-09-14
文件大小:135168
提供者:
lvpingao850227
1632位微机原理、汇编语言及接口技术第2版-习题答案
《16/32位微机原理、汇编语言及接口技术》习题解答 第2章 微处理器指令系统(习题2) 2.20 按照下列要求,编写相应的程序段: ⑴ 起始地址为string的主存单元中存放有一个字符串(长度大于6),把该字符串中的第1个和第6个字符(字节量)传送给DX寄存器。 mov dl,string[1] mov dh,string[6] ⑵ 有两个32位数值,按“小端方式”存放在两个缓冲区buffer1和buffer2中,编写程序段完成DX.AX←buffer1-buffer2功能。 mov ax,
所属分类:
硬件开发
发布日期:2009-11-28
文件大小:117760
提供者:
xiaoxue_1122
BMP位图数据结构 介绍c编程中bmp格式图片的相关信息
1:BMP文件组成 BMP文件由文件头、位图信息头、颜色信息和图形数据四部分组成。 2:BMP文件头 BMP文件头数据结构含有BMP文件的类型、文件大小和位图起始位置等信息。 其结构定义如下: typedef struct tagBITMAPFILEHEADER { WORD bfType; // 位图文件的类型,必须为BM DWORD bfSize; // 位图文件的大小,以字节为单位 WORD bfReserved1; // 位图文件保留字,必须为0 WORD bfReserved2; /
所属分类:
其它
发布日期:2010-09-21
文件大小:109568
提供者:
shanxifanshi
《1632位微机原理、汇编语言及接口技术》习题解答
第2章 微处理器指令系统(习题2) 2.20 按照下列要求,编写相应的程序段: ⑴ 起始地址为string的主存单元中存放有一个字符串(长度大于6),把该字符串中的第1个和第6个字符(字节量)传送给DX寄存器。 mov dl,string[1] mov dh,string[6]
所属分类:
硬件开发
发布日期:2008-09-01
文件大小:2097152
提供者:
w316149998
16位地址计算的小工具
16位地址计算的小工具,知道起始地址,终止地址,计算大小或者知道起始地址,大小,计算终止地址
所属分类:
硬件开发
发布日期:2013-10-23
文件大小:1048576
提供者:
yewei641955109
VB 对九帧数据的发送
串型数据RS232接口的基本概念是以高低脉冲来区分0或者1,以一个字节(Byte)为最小单位进行发送,一个Byte为8个二进制位(BIT),另外附加三个位作为起始位、停止位和奇偶校验位。在选择不使用奇偶校验的情况下,串口一次最小传送10个BIT,如果需要奇偶校验,则是11个BIT
所属分类:
VB
发布日期:2014-11-01
文件大小:10240
提供者:
ahlb1223
带有起始位的FPGA串转并 点灯程序
在实际产品开发中,需要进行点LED灯,但是芯片厂家为了节约端口,有时候会给出串行且软件寄存器可配置的数据流,然后硬件外接芯片实现转换成并行再去点灯。此时若系统内有FPGA或者CPLD就可以用它们来完成串并转换。本测试代码完成了带有起始位的串并转换,串行数据位数可以自行修改。
所属分类:
硬件开发
发布日期:2014-12-04
文件大小:187392
提供者:
hhu_2012
matlab产生m序列
只需使用matlab自带函数primpoly(n,'all') % n为反馈逻辑阶次,决定密钥长度。计算出反馈逻辑的十进制表示,则可用该算法算出以该反馈逻辑为基础任意位为起始位的m序列,只要计算机硬件强悍,可算出所有m序列。目前市面电脑一般可轻松算出百万位二进制密钥。
所属分类:
其它
发布日期:2018-04-01
文件大小:733
提供者:
u012834918
c#读写串口缓冲区(起始头2位+标志1位+数据N位+结束尾2位)
在工业嘈杂的生产环境中,可能发生各种意外。 一般的数据包格式是:起始头2位+标志1位+数据N位+校验位1位+结束尾2位. 注意:这里的起始头和结束尾是2位!!!因为有些场合1位标志位容易出错。 ------------分割线------------- c#读写串口缓冲区,发送比较简单。 接收包格式:起始头+标志位+数据位+结束尾,先收到缓冲区里暂存,然后从缓冲区里检查起始位、结束尾。无效串口数据丢弃,有效数据处理。
所属分类:
C#
发布日期:2018-04-13
文件大小:45056
提供者:
gssystems
六自由度机械臂球面写字,点位置及位姿解算
此程序以亮字为例子,计算了每个笔画起始中间终止点的位置,及六自由度机械臂末端执行器的位姿,基础坐标系x指向正前方,y指向面对x正方向的左侧,末端执行器位姿表示选择欧拉角rxryrz
所属分类:
其它
发布日期:2018-05-25
文件大小:4096
提供者:
ndyj0829
MultiRanger多功能物位计的Modbus RTU通讯.pdf
MultiRanger多功能物位计的Modbus RTU通讯pdf,西门子MultiRanger多功能物位计的Modbus RTU通讯:MultiRanger是中短量程的超声波液位计,可以测量单个或多个容器,广泛应用于各工业领域。其标配具有Modbus RTU通讯,同时具有两种通讯口,一种是RS485,一种是RJ11。本文档以RS485为例,重点说明通讯参数的设置,所用软件均为第三方软件。Exceence n Automation drives Siemens SIEMENS 所需硬件设备如下:
所属分类:
其它
发布日期:2019-09-13
文件大小:1048576
提供者:
weixin_38743506
SICK VS HOKUYO 激光限位测试报告.pdf
使用Matlab软件通过TCPIP通讯协议读取SICK激光和HOKUYO激光传感器的数据,并进行图像绘制。包含通讯流程以及程序范例222 Area DesignerUXM软件配置…… 17 2.3网络通讯方式测试 20 2.3.1网络通讯助手配置 20 2.3.2数据读取流程 20 1 SICK LMS511 11实验器材及照片 材 数量 S| CK LMS511-10100 个 S|CK端转网∏线 根 SCK端电源线 1根 220VAC转24VDC电源 个 笔记本电脑联想K4450 Matl
所属分类:
网络监控
发布日期:2019-08-18
文件大小:1048576
提供者:
zhb009527
异步通信起始位正确检测的VHDL实现
基于FPGA/CPLD的UART设计众多,本文分析了3倍频采样方法存在的不足,同时分析了16倍频采样对起始位检测的可靠性,并给出相关的VHDL硬件描述语言程序代码。
所属分类:
其它
发布日期:2020-07-27
文件大小:158720
提供者:
weixin_38744375
基于FPGA的锁相环位同步提取电路设计
同步是通信系统中一个重要的问题。在数字通信中,除了获取相干载波的载波同步外,位同步的提取是更为重要的一个环节。因为只有确定了每一个码元的起始时刻,才能对数字信息作出正确的判决。利用全数字锁相环可直接从接收到的单极性不归零码中提取位同步信号。
所属分类:
其它
发布日期:2020-10-20
文件大小:103424
提供者:
weixin_38613173
USB通信协议——循环冗佘检验位
每一个封包、令牌、数据、起始封包等都包含了用来作为错误检验的位,以用来确认跟随着封包PID字段之后的信息。而信息变化的特性是根据封包类型来决定的。每一个封包含了5或16个CRC(Cycle Redundancy Checks)位,其由封包的可能大小或类型来决定,如表所列。 表 封包类型与字段 CRC的计算方式是将要传输的数据块当作一堆连续位所构成的整个数值,并将此数值除以一个特定的除数。这个除数是以二进制来加以表示的,通常又称为衍生多项式(generatton polynomoa
所属分类:
其它
发布日期:2020-11-13
文件大小:90112
提供者:
weixin_38621427
EDA/PLD中的异步通信起始位正确检测的VHDL实现
摘要: 基于FPGA/CPLD的UART设计众多,本文分析了3倍频采样方法存在的不足,同时分析了16倍频采样对起始位检测的可靠性,并给出相关的VHDL硬件描述语言程序代码。 关健词: 异步数据;UART;FPGA/CPLD;VHDL 概述 随着电子设计自动化(EDA)技术的发展,可编程逻辑器件FPGA/CPLD已经在许多方面得到了广泛应用,而UART(通用异步收发器) 是在数字通信和控制系统中广泛使用的串行数据传输协议。因此越来越多用户根据自己的需要,以EDA技术作为
所属分类:
其它
发布日期:2020-11-25
文件大小:79872
提供者:
weixin_38621638
EDA/PLD中的基于FPGA的锁相环位同步提取电路设计
基于FPGA的锁相环位同步提取电路设计 浙江工业大学之江学院 周云水 概述 同步是通信系统中一个重要的问题。在数字通信中,除了获取相干载波的载波同步外,位同步的提取是更为重要的一个环节。因为只有确定了每一个码元的起始时刻,才能对数字信息作出正确的判决。利用全数字锁相环可直接从接收到的单极性不归零码中提取位同步信号。 一般的位同步电路大多采
所属分类:
其它
发布日期:2020-12-09
文件大小:61440
提供者:
weixin_38631049
异步通信起始位正确检测的VHDL实现
摘要: 基于FPGA/CPLD的UART设计众多,本文分析了3倍频采样方法存在的不足,同时分析了16倍频采样对起始位检测的可靠性,并给出相关的VHDL硬件描述语言程序代码。 关健词: 异步数据;UART;FPGA/CPLD;VHDL 概述 随着电子设计自动化(EDA)技术的发展,可编程逻辑器件FPGA/CPLD已经在许多方面得到了广泛应用,而UART(通用异步收发器) 是在数字通信和控制系统中广泛使用的串行数据传输协议。因此越来越多用户根据自己的需要,以EDA技术作为
所属分类:
其它
发布日期:2021-01-19
文件大小:78848
提供者:
weixin_38526650
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