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  1. EDA/PLD中的帧同步系统的FPGA设计与实现

  2. 1 引言 　　数字通信时，一般以一定数目的码元组成一个个“字”或“句”，即组成一个个“帧”进行传输，因此帧同步信号的频率很容易由位同步信号经分频得出，但每个帧的开头和末尾时刻却无法由分频器的输出决定。为此，帧同步的任务就是要给出这个“开头”和“末尾”的时刻。通常提取帧同步信号有两种方法：一类是在信息流中插入一些特殊的码组作为每帧的头尾标记。另一类则不需要加入码组，而是利用数据码组本身之间彼此不同的特性实现同步。这里采取第一种方法——连贯式插人法实现帧同步。所谓连贯式插入法就是在每帧开头插入帧同

  3. 所属分类：其它

    • 发布日期：2020-11-10
    • 文件大小：279552
    • 提供者：weixin_38668225

  1. EDA/PLD中的用VHDL设计专用串行通信芯片

  2. 在通信系统中，通信芯片是整个硬件平台的基础，它不仅完成OSI物理层中的数据发送和接收，还能根据传输方式和协议的不同实现不同的数据校验方式及数据组帧格式。 　　目前，许多厂商都提供通用的串行通信芯片，其传输方式分为同步方式和异步方式。其中，异步芯片大多与INTEL的8250芯片兼容；而同步方式，由于一般涉及到所支持的传输协议（BSC、HDLC、SDLC等），所以当用户要求应用特定的同步传输协议时，往往需要设计专用的SRT（同步收发器）。以前，大多采用通用的逻辑元器件进行设计，这导致了设计和调试过

  3. 所属分类：其它

    • 发布日期：2020-11-10
    • 文件大小：311296
    • 提供者：weixin_38531788

  1. EDA/PLD中的基于FPGA的数字复接系统帧同步器设计与实现

  2. 摘要：介绍了应用ＦＰＧＡ技术进行帧同步器设计的实现原理、系统框图及设计中需要注意的问题，给出了用ＶＨＤＬ描述的几个模块的源代码。 关键词：数字复接；帧同步器；ＦＰＧＡ在数字通信网中，为了提高传输效率，常常需要将若干路低速数字信号合并成一路高速数字信号，以便通过高速信道进行传输。实现此功能的设备称为数字复接系统。数字复接系统包括发送端和接收端两部分，通常称为复接器和分接器。为了使分接器的帧状态相对于复接器的帧状态获得并保持相位关系，以便正确地实施分接，数字复接系统在发送端把低速数字信号合并为

  3. 所属分类：其它

    • 发布日期：2020-12-10
    • 文件大小：75776
    • 提供者：weixin_38702931

  1. EDA/PLD中的一种基于FPGA的帧同步提取方法的研究(EP20K400EBC652-1X)

  2. 在可靠的通信系统中，要保证接收端能正确解调出信息，必须要有一个同步系统，以实现发送端和接收端的同步，因此同步提取在通信系统中是至关重要的。一个简单的接收系统框图如图１所示。 本文介绍一种基于现场可编程门阵列（ＦＰＧＡ）的同步方案。ＦＰＧＡ是与传统ＰＬＤ不同的一类可编程ＡＳＩＣ，它是将门阵列的通用结构与ＰＬＤ的现场可编程特性结合于一体的新型器件，最早由美国Ｘｉｌｉｎｘ公司于１９８５年推出。ＦＰＧＡ具有集成度高、通用性好、设计灵活、开发周期短、编程方便、产品上市快捷等特点，它的

  3. 所属分类：其它

    • 发布日期：2020-12-08
    • 文件大小：146432
    • 提供者：weixin_38546622

  1. EDA/PLD中的一种基于FPGA的帧同步提取方法的研究

  2. 在可靠的通信系统中，要保证接收端能正确解调出信息，必须要有一个同步系统，以实现发送端和接收端的同步，因此同步提取在通信系统中是至关重要的。一个简单的接收系统框图如图１所示。 本文介绍一种基于现场可编程门阵列（ＦＰＧＡ）的同步方案。ＦＰＧＡ是与传统ＰＬＤ不同的一类可编程ＡＳＩＣ，它是将门阵列的通用结构与ＰＬＤ的现场可编程特性结合于一体的新型器件，最早由美国Ｘｉｌｉｎｘ公司于１９８５年推出。ＦＰＧＡ具有集成度高、通用性好、设计灵活、开发周期短、编程方便、产品上市快捷等特点，它的

  3. 所属分类：其它

    • 发布日期：2020-12-08
    • 文件大小：144384
    • 提供者：weixin_38729108